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用什么Verilog 编程软件好呢

xie0jing0
工程师
2010-07-20 20:20:42     打赏
大家都用什么软件来写Verilog 代码呢，直接用ISE吗
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关键词： 什么     Verilog     编程     软件     好呢    

Jason_Zhang
高工
2010-07-20 21:41:49     打赏
2楼
我用UltraEditor，有提示功能（就像VC中的Tomoto插件一样）。
ISE支持它，很方便的

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xie0jing0
工程师
2010-07-21 18:57:53     打赏
3楼
ISE支持,是什么意思呢

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Jason_Zhang
高工
2010-07-21 20:23:31     打赏
4楼
ISE中可以设置UE为外部编辑器，这样你在ISE中双击文件，就会自动用UE打开了

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MatchPoint
菜鸟
2010-07-22 20:46:35     打赏
5楼

modelsim


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xie0jing0
工程师
2010-07-24 09:53:33     打赏
6楼
原来这么方便。在网上看到有推荐emacs的，感觉很专业，贴过来一段： 呵呵，看来这里用emacs用的人很少啊，那给大家推荐一下吧，UNIX下的用的，主要优点是可以自动生成输入输出端口，在always中用到的变量可以自动生成成reg声明，模块例化时，可以自动生成wire声明，而且例化时可以采用模板进行批量例化，别小看这一功能，当设计复杂，尤其是层次很多时，自动例化会极大提高你的设计效率。 其实呢。emacs的verilog mode这个功能在gvim下面也能用。只要去网上下载一个plug in的包就可以了。 不知道有哪些厂用这个。我公司是要求用这个。这样不仅可以检查自己编的有没有问题，还可以发现相关模块有没有typo一类的错误。

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suwon
菜鸟
2010-07-30 15:27:39     打赏
7楼
UltraEditor蛮好的

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jiangnanyu
菜鸟
2010-08-25 17:56:52     打赏
8楼

还没写过代码那


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Jason_Zhang
高工
2010-08-26 20:18:13     打赏
9楼

挺不错的软件，回头找来看看


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cherial
菜鸟
2010-08-28 10:35:16     打赏
10楼

没有人用quartus 自带的吗？


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