理解Altera CPLD中的时钟
本应用笔记介绍了MAX® II 和MAX V 器件中的外部与内部时序参数以及时序模型。
Altera® 器件提供了与仿真到应用相符合的可预测器件性能。在进行器件编程前,您可以确定设计中最差情况下的时序延迟。
您可以使用以下几种方式来估算传播延迟:
■ Quartus® II TimeQuest 时序分析器
■ 本应用笔记提供的时序模型
■ MAX II器件手册的DC and Switching Characteristics 章节和MAX V器件手册的DC and Switching Characteristics for MAX V Devices 章节中列出的时序参数。详见an629_CN.pdf。
我要赚赏金打赏帖 |
|
|---|---|
| STM32C0116DK开发探索记(3)被打赏¥30元 | |
| STM32C0116DK开发探索记(2)被打赏¥24元 | |
| STM32C0116DK开发探索记(1)被打赏¥29元 | |
| 谨防极海G32M3101电机评估板易跌落的陷阱被打赏¥24元 | |
| 【全网首拆】M5STACK ATOM系列开发板拆解 / AtomS3R-CAM摄像头更换方法(提高10倍像素)被打赏¥26元 | |
| 基于MCP23S17的输入输出功能模块控制被打赏¥20元 | |
| 【S32K3XX】SPD 软件包使用Link文件修改被打赏¥22元 | |
| Switch-Case局部变量定义问题被打赏¥23元 | |
| 基于米尔TIAM62L开发板的串口通信及应用被打赏¥20元 | |
| PCF8574功能模块及其使用被打赏¥20元 | |
我要赚赏金
