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请问大婶们 DSP和FPGA 怎么连接


6楼
双端口RAM和FIFO本质并没有多大区别,都是解决异步时钟域数据同步的有效手段,从实现的角度来讲,前者的控制稍复杂些,但效率高,如果你的FPGA资源足够大的话,使用编译器(quartus-II或者ISE)自带的IP实现最好。
就你所言,这里你需要处理的是大数据量的图像信息,所以使用并行总线传输是首先,分两种情况考虑:
1、数据与地址分开的情况:需要时钟线、读写线,地址总线和数据总线(典型参考如ARM的APB总线)
2、数据线与地址复用的情况:需要始时钟线、读写线,地址锁存线和地址/数据总线(典型参考如ADuC7026中的memory- bus总线)
时钟信号和控制信号都由master控制,slave根据始终信号进行同步,根据控制信号进行读写状态更新
就你所言,这里你需要处理的是大数据量的图像信息,所以使用并行总线传输是首先,分两种情况考虑:
1、数据与地址分开的情况:需要时钟线、读写线,地址总线和数据总线(典型参考如ARM的APB总线)
2、数据线与地址复用的情况:需要始时钟线、读写线,地址锁存线和地址/数据总线(典型参考如ADuC7026中的memory- bus总线)
时钟信号和控制信号都由master控制,slave根据始终信号进行同步,根据控制信号进行读写状态更新

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