请教一下在编写代码的问题

工程师

2012-11-20 11:26:42 打赏

在网上看了许多的代码每个人的都不一样
在编写Verilog HDL代码时是可不可以模块化，
比如
数码管显示部分、
LCD1602的显示部分、
LCD12864的显示部分
VGA的显示、
他们都有自己的输入接口如果可以模块化
在编写代码时就可以直接的使用不必重新的编写
如何实现他们

关键词：请教一下编写代码问题

院士

2012-11-20 12:58:23 打赏

2楼

我也是菜鸟啊~~

貌似可以实现类似的功能。我记得当年我使用VHDL语言实现了数码管的模块化

高工

2012-11-20 13:18:33 打赏

3楼

模块当然可以例化，你找本verilog的语法书，找有关章节学习一下吧，我之前发过的帖子里面有发过verilog方面的书籍。

高工

2012-11-20 21:18:06 打赏

4楼

自己试着写呗~~
只要把输入接口定义好，其他应该不是问题

工程师

2012-11-21 09:38:31 打赏

5楼

我试试看，谢谢大家的指导

助工

2012-11-21 23:07:13 打赏

6楼

好好学习！！

助工

2012-11-27 16:53:00 打赏

7楼

KANKAN!!!!!!!!

助工

2012-11-27 19:29:13 打赏

8楼

可以吧！！！！

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