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电子产品世界 » 论坛首页 » 嵌入式开发 » 国产MCU » 请问3588Qpcie3.0RC和EP端是否支持采用独立的REFCLK时钟？

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请问3588Qpcie3.0RC和EP端是否支持采用独立的REFCLK时钟？

abgh668
高工
2023-06-23 16:14:31     打赏

问题描述及复现步骤：PCIE通常采用Common REFCLK Rx Architecture （CC）：

PCIE Separate Refclk Architecture:

请问3588Q pcie3.0 RC和EP端是否支持采用独立的REFCLK时钟。如果支持，有没有特殊要注意的地方。

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关键词： 3588Q     pcie3.0     REFCLK    

2220193197
助工
2023-06-23 16:14:43     打赏
2楼

我们根据rk原厂的硬件设计要求是要使用同一时钟源的，Separate Refclk Architecture 的时钟架构模式并没有使用过


评论
abgh668
高工
2023-06-23 16:14:58     打赏
3楼

好的，谢谢。
设计时把Separate Refclk 和 Common Refclk都加上（FPGA MGT两路时钟输入），看看Separate Refclk的具体效果。如果不行，转为Common Refclk工作。


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HangYongmao
专家
2023-06-24 01:30:40     打赏
4楼

感谢楼主的分享，很实用了。


评论
HangYongmao
专家
2023-06-24 01:36:05     打赏
5楼

感谢楼主的分享，很实用了。


评论
springvirus
高工
2023-06-24 05:53:42     打赏
6楼

感谢楼主的分享，很实用了。


评论
hymyfzgs
专家
2023-06-24 09:26:33     打赏
7楼

感谢楼主的分享


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