本应用指南介绍了在 Virtex™-4 器件中，利用直接时钟控制技术实现 DDR2 SDRAM 物理层设计。 直接时钟控制技术利用了 Virtex-4 系列所独有的某些架构特性，例如每个 I/O 模块 (IOB) 中均具备一个 64 Tap 绝对延迟线。
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