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落月风情的进程贴(晒晒我拙劣的焊工)

高工
2013-06-25 21:31:31     打赏

拿到板子有一段时间了,中间有些别的事情耽搁了,进过不间断的焊接,今天终于完工了,话不多说上图:

手机拍照,请见谅。

正在学习VHDL,争取尽快完成第一个测试demo。




关键词: CPDL     DIY    

高工
2013-06-25 21:32:34     打赏
2楼
由于没有合适的电源,选择USB供电来着。

高工
2013-06-25 23:23:17     打赏
3楼
书上说verilog学起来比VHDL要简单,求鉴定

高工
2013-06-26 08:46:30     打赏
4楼
那就倾向于verilog吧,看看数电,看看verilog,没事写个demo玩玩,jobs多多指点啊

高工
2013-06-26 08:47:39     打赏
5楼
必须手工焊,没人给焊只好自己动手了,话说焊的多了就没啥难度啦。

高工
2013-06-26 08:48:42     打赏
6楼
早该换了,不过先凑合着用呗,吃饱饭要紧啊,哈哈哈

高工
2013-06-26 11:12:38     打赏
7楼
此言有理,学精一门很费劲,精力达不到,会使用一门,简单的了解下另一门。

高工
2013-06-26 11:14:22     打赏
8楼
相对VHDL来说简单些,可能规则上要求没有那么高,一般的小型应用Verilog还是比较多的。多多指点啊

高工
2013-06-26 11:15:00     打赏
9楼
吓着路人甲了,哈哈哈

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