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FPGA经验总结:时序是设计出来的

助工
2013-07-01 13:26:47     打赏

每一个项目都有很严格的评审,只有评审通过了,才能做下一步的工作。

       
以做逻辑为例,并不是一上来就开始写代码,而是要先写总体设计方案和逻辑详细设计方案,要等这些方案评审通过,认为可行了,才能进行编码,一般来说这部分工作所占的时间要远大于编码的时间。总体方案主要是涉及模块划分,一级模块和二级模块的接口信号和时序(我们要求把接口信号的时序波形描述出来)以及将来如何测试设计。在这一级方案中,要保证在今后的设计中时序要收敛到一级模块(最后是在二级模块中)。

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关键词: 经验总结     时序     设计     出来    

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