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想学FPGA请问是学VHDL还是Verilog?请指点迷津，谢谢。

lfhrm
菜鸟
2013-01-09 22:01:11     打赏
VHDL与Verilog哪种更容易些，现在用哪种的人多，哪种设计经验范例多些呢？
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关键词： 想学     请问     还是     Verilog     指点迷津     谢谢    

zqh1630
高工
2013-01-10 09:27:55     打赏
2楼

我听别人说用Verilog比较多，不过我们上学是学的VHDL~~


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liweicheng
专家
2013-01-10 09:28:16     打赏
3楼

这就像单片机的汇编语言和C语言一样，各有利弊


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zhuwei0710
高工
2013-01-10 09:33:54     打赏
4楼
1、如果你有C语言基础，显然是verilog。1-2周可以搞定。 如果没有，随便哪种都行。 2、用两种的都非常多，美国是Verilog，欧洲是VHDL，国内verilog和VHDL都有 3、两种范例都很多。 建议精通一门，另一门可以阅读代码。 我学的是verilog，一周没问题了，至于精通，还在进行中。 为了看代码方便，我也稍微学了VHDL，看了半天语法规则，可以看懂了，只要熟悉一门，另一门很好学的。

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youzizhile
助工
2013-01-10 09:34:41     打赏
5楼
一般企业用的都是verilog，语法比较灵活，容易出错，和c语言比较类似。vhdl语法严谨，不容易出错。两种语言都可以学习使用，没有什么利弊，建议初学还是学习vhdl

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小枫哥
助工
2013-01-10 09:39:11     打赏
6楼
嗯，学数电的时候老师也建议学verilog，那个容易懂，上手很快。

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antonine
高工
2013-01-10 12:57:24     打赏
7楼
月经帖，随便选一个都可以了

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HXW718059156
高工
2013-01-11 00:16:39     打赏
8楼
最好两者都懂，建议深入学习和掌握Verilog HDL

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SYD2012
专家
2013-01-18 16:24:10     打赏
9楼
VHDL是相当不好学！！！

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YD2012
助工
2013-01-19 10:17:05     打赏
10楼
不要学vhdl

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