我个人觉得吧，不管用状态机还是计数器来实现仿顺序操作，实质上来讲，我觉得都是一样的，都是利用寄存器相应的状态，去控制执行顺序，而文中作者说利用他的方法有许多好处，但并没有指明，忘高手多多指教。。。。。。。。。
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在仿顺序操作中，FPGA中常常用状态实现，而在《verilogHDL 那些事——建模篇》中，作者并没使用状态机，而是用计数器来控制执行的顺序
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