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程序不稳定的问题，请教！ [

菜鸟求教
助工
2013-05-13 14:00:09     打赏
写的一个Verilog程序，代码稍微动一下，实现的功能不变，比如1.一个逻辑与由子模块从挪出放到主程序里，其中的一部分管脚输出就变了，再如2.将一些注释之类的去掉，逻辑运算符等运算符的两侧留的空格去掉，重新编译结果又变了，是啥原因呢？
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关键词： 程序     不稳     定的     问题     请教    

zqh1630
高工
2013-05-13 17:08:05     打赏
2楼
不懂，帮顶~~

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maxliu
助工
2013-05-13 17:12:36     打赏
3楼

最好是把程序贴上来,因为这个好多原因造成

1. 不小心修改了逻辑或输入输出接口;

2. 很有可能修改了逻辑功能;


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啸风
专家
2013-05-13 17:15:18     打赏
4楼
3楼说的对   贴程序出来吧    

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emusic
助工
2013-05-13 17:17:19     打赏
5楼
这不能叫做程序不稳定吧。。。。。。

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