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FPGA PLL

romi
菜鸟
2013-06-12 11:45:53     打赏
最近在整PLL跟踪外界可变信号，来实现频率相位的同步，但是使用Quartus II中的PLL模块时发现其输入是固定的，自己虽然把外界的信号接入了，但是输出没有规律，也就是乱的，后来百度了一下知道了有一个可重新配置的PLL模块，可是自己器件等级不够，用不了，求大虾们指点迷津啊  或是指导一下别的方法，甚是感谢
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jackwang
院士
2013-06-13 08:34:41     打赏
2楼
这个是技术问题哦

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romi
菜鸟
2013-06-13 17:00:09     打赏
3楼
嗯，还没理解透PLL现在先准备用TI专用的PLL芯片来完成相应工作

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Chasel
高工
2013-06-13 18:28:40     打赏
4楼
先学后做，或者边学边做。。。

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romi
菜鸟
2013-06-16 09:04:52     打赏
5楼
嗯， 在学啊，周围缺少讨论的人，这不自己有疑惑解决不了了才上论坛问么

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shark1234567
助工
2013-06-16 22:53:18     打赏
6楼
我遇到过和你相同的问题，最后是放弃了，没有重配置PLL，一点招都没有

评论
romi
菜鸟
2013-06-24 09:11:36     打赏
7楼
嗯，芯片有点低端，我现在都用外部电路来做了

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