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ADI在线设计峰会2013—高速系统的频率合成和时钟产生（10月15日 10:00）

Nancy
高工
2013-10-14 16:13:08     打赏
高速系统的频率合成和时钟产生

时间：2013年10月15日 10:00      

  

简介：频率合成和时钟产生现已成为高速数据采集和RF设计中的关键因素。研讨会将讨论频率合成器的主要类型——锁相环(PLL)和直接数字频率合成器(DDS)——以及每一种类型所适合的应用。还将详细讨论频率合成器设计的各个方面。时钟分配和转换等其他应用也会涉及，并说明欠佳时钟导致的一些问题。研讨会将给出一些欠佳时钟设计的例子，以及正确设计可得到的结果。

预先报名：http://seminar.eepw.com.cn/seminar/show/id/149

 

凡报名且全程参加在线研讨会的听众，会后将每人得到EEPW提供的10元京东礼品券。

 

演讲专家：秦宇 亚洲技术支持中心 应用工程师

毕业于北京邮电大学， 硕士学位。2010年加入ADI，专注于射频及高速产品的应用。

 

 

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关键词： 设计     高速     系统     频率     合成     时钟    

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