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fpga除法器的一些问题

xuhongming
菜鸟
2014-03-26 12:23:43     打赏
        学习fpga有一段时间的朋友们，你们有没有比较好的除法器的设计思想，目前我的思想进局限于移位—>比较—>减法这种思想，希望有好的想法的朋友介绍一下。目前正在做等精度频率计除法模块，用quartus中自带的除法器时，当输入被除数为28位，除数为16位时，就消耗了780多个逻辑元件了。
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friends
高工
2014-03-26 22:11:30     打赏
2楼
硬件做除法器是这样的，可综合的除法运算都是靠移位操作完成的，特别耗资源，且只有除数为2的n次方才可被综合

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xuhongming
菜鸟
2014-03-27 16:02:08     打赏
3楼

哦，学习了，谢谢版主回复


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