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组合逻辑电路作业请教

院士
2014-05-26 17:13:03     打赏
 

   这里是组合逻辑电路作业中的一部分,破折号后面的小字是我对语句的理解,连同后面的问题一起来请教大家。由于是第一次写这个,基本上是“照葫芦画瓢”,所以在格式上是照搬的。

4选1数据选择器

代码实现:

 module mux(a,

            b,

            c,

            d,

           sel,

            1

);

       //输入输出信号定义

input   a ; //输入--地址数据

input   b ; //输入--地址数据

input   c ; //输入--地址数据

input   d ; //输入--地址数据

input  sel; //选择输入

output  1 ; //输出

  //逻辑部分

assgin 1=sel ? d:c:b:a

  //根据地址输入选择输出

endmodule

   另外,8选1数据选择器”与“4选1”的区别,就在于输入的数据地址的数量不同,在assgin  1=sel ?后面供选择的对象也不一样。

  不知这些理解对不对,请老师和同学们指点?




关键词: 芯创FPGA          学习交流     问题请教    

高工
2014-05-26 20:30:47     打赏
2楼
这样写不对的哦,看样子你对assgin语句的用法还不是很熟悉,找本语法书看看吧,4选1和8选1 ,可以考虑用case语句实现比较简单。自己试着写写吧。另外验证自己写的是否正确,可以编译下看看有没有语法错误,通过功能仿真验证是否实现了电路功能。

院士
2014-05-26 22:33:57     打赏
3楼
谢谢指点,我看书去了。

院士
2014-05-27 09:07:35     打赏
4楼

助工
2014-06-12 22:25:07     打赏
5楼
建议你在敲代码之前,先画一下电路的大致框图,之后在按照这个框图再敲代码。这样你就会发现sel 应该是2bit 而不是一位,而且选择器,译码器,编码器之类的组合逻辑电路一般都是多用case语句而不是assign数据流语句。

院士
2014-06-12 22:40:19     打赏
6楼
   谢谢你的指点,我正在找书上相关的内容从头看,有些东西接触不多,理解起来有点费劲。

助工
2014-06-12 22:59:47     打赏
7楼
不敢说指点,相互学习

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