如何处理没有使用的IO管管脚，肯定很多设计过程师都在迷茫中。这个问题该如何呢？
是悬空还是应该做其他处理，如果悬空，当设计管脚不够用必然会造成整个板卡的改版。
如果去避免这个问题，这也是Xilinx ISE强大的地方。
我们可以在生成BIT的时候，完成这个工作。
具体设置，见图：选择上下拉或者高阻态。
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