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verilog编程中的问题

luden
菜鸟
2005-09-06 21:09:35     打赏

在线测试后发现如下问题：
FPGA往PC机通过串口发送数据，没有任何的误码。（我觉得由此可推测，波特率应该没有问题）
PC机往FPGA发送数据，FPGA获得数据后，发回FPGA
大部分情况下不误码，偶尔误码，而且误码的规律
老是把一个16进制数变成两个16进制数发回PC机，而
且发回的两个16进制数中，第一个老是00。

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关键词： verilog     编程     中的     问题    

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