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国内工程师有谁了解和在用Cadence吗?
[B]★ 培训内容:[/B]
(1) 高速嵌入式系统原理图设计
内容涉及嵌入式系统原理图设计的方方面面,包括:电源、时钟、复位、特殊引脚处理、存储器的连接、PCI/USB/以太网等的接口等内容。
(2) 高速PCB系统设计
随着逻辑开关速度的加快,数字系统设计也同样遭遇到像模拟设计时所遇到的许多困难。比如,在低速时,一条线可以很容易的连接两个电路元素,而在高速时,因为有太多的感应系数,这一条线就不能很容易的连接相同的两个电路元素。这门课程讲授信号完整性概念:模拟干扰信号出现的原因,如何预测它们,以及如何设计电路和制作在模拟影响情况下仍能可靠运转的电路板。课程的核心内容包括:
介绍传输线理论
传输线之间的串扰,其他电路问题以及如何将这些干扰最小化
非理想化返回路径,同期转换噪声及功能传输
信号完整性分析,包括信号路径分析,计时预算,时钟同步
测量技术
电磁波放射,干扰规律及系统噪声最小化
(3) Cadence 工具使用培训
Concept HDL Front-to-Back Design Flow – 原理图输入工具
PCB Librarian – 器件建库工具
Allegro PCB Layout System – PCB板布局布线工具
Specctra AutoRoute Basics – 基本自动布线器
Advanced Specctra Autorouting Techniques – 高级自动布线器
SpecctraQuest Foundations – 信号完整性仿真工具
Advanced SpecctraQuest Techniques – 高级信号仿真工具
[B]★ 参加人员:[/B]
从事DSP、FPGA、ARM、SOC等嵌入式系统设计的硬件开发人员,高校、科研院所和企业从事嵌入式系统硬件设计科研或教学人员。
[B]★ 时间和地点:[/B]
2005年11月4日-11月6日 上海华东理工大学
[B]★ 报名办法:[/B]凡参加培训班的同志,请用正楷认真填写报名回执,可邮寄亦可用传真报名。我们将根据报名先后顺序发送报到通知。并详告具体报到时间、地点及行车路线。为简化报名程序,您可以选择在网上报名,我们工作人员会主动给您联系,并发培训通知和确认函,告知您上课具体事宜!
地 址:北京市83-055信箱 (邮编:100083)
联系电话:010-62005506 62359586(兼传真)
手 机:13910313321
联系人: 孙培
网 站:[URL=www.DSPTech.com.cn]www.DSPTech.com.cn[/URL]
E-mail:training@DSPTech.com.cn
[align=right][color=#000066][此贴子已经被作者于2005-11-3 9:07:39编辑过][/color][/align]
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