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vhdl vhdl编程问题

院士
2006-09-17 18:14:16     打赏
vhdl vhdl编程问题



关键词: 编程     问题    

院士
2006-12-22 22:43:00     打赏
2楼
问 请大家帮忙看一下这个程序应该如何修改,先谢谢了。
process(st,href)--判断是否图象是否存储结束
    begin
       if (st='0') then
          h_9<="000000000";
       elsif (h_9<"111100000") then
          if href'event' and href='0'  then
           h_9 <= h_9 + 1;   
        
           end if;
       end if;
end process;
VHDL syntax error: attribute name or qualified expression must have
identifier, '(', or RANGE, but found and instead 1: event后面多拉个‘把 2: 提示是第六行有问题。语法不对。那个and有问题,可能。 3: 还有问题谢谢大家帮忙,可现在又有问题了。改完后显示unsupported feature error: conditional statement in this region for signals not supported.是我的信号定义有问题吗还是范围的问题呢应该查哪里呢怎么个改法啊?signal 和port有什么区别呢有没有通俗一点的解释呢?

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