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VHDL,VS,Verilog,HDL 弱问：VHDL　VS Verilog HDL，学哪个好啊?

jackwang

院士

2006-09-17 18:14:16 打赏

只看楼主 1楼

VHDL,VS,Verilog,HDL 弱问：VHDL　VS Verilog HDL，学哪个好啊?

关键词： Verilog 弱问哪个好啊

jackwang

院士

2006-12-22 22:43:00 打赏

2楼

问市面上好像VHDL的书比较多，Verilog HDL书比较少
不过我买了一本讲VHDL的书，感觉学起来比较费劲，好繁琐啊
听说Verilog HDL是类似C，C我还是比较熟的，而且我自己本身主要是做软件，
不太想在硬件设计上花太多时间，所以请问诸位，我是不是应该学习verilog HDL啊？

谢先

答 1: re:晕－－－要看学了哪个有用，告诉你９８％的可能是Ｖｅｒｉｌｏｇ。
不过别指望学好Ｃ就好学Ｖｅｒｉｌｏｇ，软、硬件编程思想差很多，很少有人两者兼备的（我的意思不只是会写，而是要写好）。答 2: re
谢谢flyfei
答 3: Verilog 入门比较快，但想精通难！答 4: 還是Verilog好啊答 5: 人的精力是有限的，怎么容易怎么来,Ｖｅｒｉｌｏｇ答 6: re
各大论坛上比较常见的是关于VHDL的讨论，而且我已经学了一点VHDL了，不想换了，呵呵。

用VHDL实现四个计数器和一个键盘扫描电路应该问题不大吧,芯片选用epm7128,处理器是44b0，哪位有做过类似课题的朋友可否提点建议，现在对于44b0+CPLD如何实现上面两个功能不是很清楚

谢先答 7: 我觉得VHDL好学以前学VHDL,觉得和VB差不多,很形象很直观,格式也很整齐.

现在学verilog HDL看觉很别扭!有人说它像C,哪像了!预处理用`而不是#,一堆begin end,一点也没有{}那么爽!

总之我觉得,对我来说,还是VHDL好学,还是VHDL整齐!

不过,现在的确是用verilog更多一些... 答 8: 与VHDL和Abel HDL相比看起来像C 答 9: Verilog 入门比较快答 10: 两个都会的人才有发言权，我只会VHDL 答 11: 我两个都看感觉查不多记住啊

你写的不是程序啊

你是在描述电路的

好好努力

做FPGA 呢看VHDL 做IC 设计呢看 VERILOG 呵呵答 12: 不准备客气如果用犹豫的时间拿来学一种语言的话，也许你已经就学会了一样了。自己体会过就知道答 13: re
非常赞同vinhao所说，我就有这个毛病,呵呵

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