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VHDL,Verilog,System verilog比较【FPGA/CPLD】苏丹红\|浏览：6166\|回复：15\| moyi 2014-11-14 10:46:04
FPGA/CPLD的资料共享【FPGA/CPLD】叮叮当当\|浏览：9836\|回复：23\| zhangyaoliang 2014-11-13 13:12:16
AD采样值还原为实际值的问题【DSP系统】 QIQI214\|浏览：30\|回复：5\| paradoxfx 2014-11-12 22:08:09
关于lcell的一个问题【FPGA/CPLD】 271303204\|浏览：12679\|回复：13\| flyag 2014-11-09 08:47:54
DSP芯片如何与这3个串行外设进行连接？【DSP系统】 yhc6541306\|浏览：2840\|回复：4\| paradoxfx 2014-11-08 22:36:36
视频图像处理不知用dsp处理好还是用matlab进行处理好【DSP系统】站的高尿的远\|浏览：2715\|回复：5\| paradoxfx 2014-11-07 17:49:36
verilog存储器类型变量，占用资源较多 reg [22:0] rom_base_10Hz [0:laser_out_time_table-1]; 【FPGA/CPLD】 miaoxikui\|浏览：2427\|回复：0\| miaoxikui 2014-11-05 23:40:17
时钟分频问题【FPGA/CPLD】站的高尿的远\|浏览：1954\|回复：1\| lianggui5 2014-11-05 10:02:30
C6713的boot汇编代指令理解问题：【DSP系统】 52mcu\|浏览：7370\|回复：10\| paradoxfx 2014-11-03 22:02:08
走过，路过的大虾、小虾，谁见过c6713 DSP 的纯汇编语言的CCS例子工程？？【DSP系统】 52mcu\|浏览：2937\|回复：5\| paradoxfx 2014-11-03 20:20:39
强大的工具FPGA Editor（二）修改输入信号极性【FPGA/CPLD】九哥\|浏览：3335\|回复：6\| 特洛几 2014-11-03 16:48:35
TMS320F2812小系统电路图【DSP系统】 zhaoying818\|浏览：1663\|回复：1\| areak 2014-11-01 17:27:05
关于时钟的调试的功能，有些迷惑，请大神指教解答！！万分感谢！！！【FPGA/CPLD】小菜110\|浏览：1617\|回复：0\| 小菜110 2014-10-31 19:56:17
烧写hex文件到flash问题【DSP系统】 sundonga\|浏览：5790\|回复：3\| zhaoying818 2014-10-29 22:04:34
关于nCEO管脚复用的疑问【FPGA/CPLD】 happysheep\|浏览：8712\|回复：7\| 益达的甜 2014-10-29 11:53:02
有接触过触摸感应芯片的朋友吗? 【DSP系统】 scofield\|浏览：3787\|回复：2\| 啸风 2014-10-29 09:40:03
FPGA入门——同步复位与异步复位【FPGA/CPLD】 molly931018\|浏览：2623\|回复：1\| 何富和 2014-10-28 20:48:44
菜鸟求助：VHDL计数器设计问题【FPGA/CPLD】一花一世界\|浏览：2812\|回复：1\| aizaixidian 2014-10-28 18:36:06
求助CPLD编程 DSP 【FPGA/CPLD】 Akonzxy\|浏览：1706\|回复：0\| Akonzxy 2014-10-24 14:52:46
DSP与MCU、ARM和FPGA的区别【DSP系统】 zhaoying818\|浏览：3620\|回复：2\| zhaoying818 2014-10-23 15:42:30
DSP入门之旅【DSP系统】 zhaoying818\|浏览：1890\|回复：2\| zhaoying818 2014-10-21 11:58:53
有用zedboard来控制A5N电机的吗？【FPGA/CPLD】 taozhengxin\|浏览：1803\|回复：1\| 南盗 2014-10-20 14:33:33
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基于TI TMS320C6748的DSP视频和OMAPL138的SYSLINK双核开发视频【DSP系统】 simon1\|浏览：3120\|回复：0\| simon1 2014-10-16 14:58:31
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把DSP TMS320F28XXX的程序段从flash复制到ram中运行（理论篇）【DSP系统】南盗\|浏览：4025\|回复：1\| 何富和 2014-09-28 21:11:30
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reg [29:0] rom_10Hz_jingpin [0:99];类型的存贮器用for循环初始化的问题【FPGA/CPLD】 miaoxikui\|浏览：3520\|回复：8\| lianggui5 2014-09-28 10:29:09
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