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面向Virtex™-II Pro FPGA的DDR2 SDR
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用于 RAID6 奇偶生成/数据恢复控制器的硬件加速器
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Using Digitally Controlled Imp
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参考设计：带有 OPB 中心 DMA 的 MCH OPB E
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从配置 PROM 读取用户数据
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在 Spartan-3A FPGA 内实现 DDR2-400
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使用 Virtex-4 器件的 DDR2 控制器（267 M
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Virtex-5 FPGAs RLDRAM II 寄存器接口
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Accelerating System Designs Re
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High-Performance DDR2 SDRAM In
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The purpose of this white pape
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Virtex 器件中的多个 CAM 设计概述
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Parameterizable LocalLink FIFO
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Self-Addressing FIFO
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FIFOs Using Virtex-II Block RA
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FIFOs Using Virtex-II Shift Re
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Serial-to-Parallel Converter -
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170 MHz FIFOs Using the Virtex
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FIFO Generator v2.2
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利用 EMIF 接口 Xilinx FPGA 和 TI DS
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使用DSP48 DDR 技术的Alpha Blending
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Forward Error Correction on IT
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A 3/4/5/6X Oversampling Circui
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Viterbi Decoder Block Decoding
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数字电视广播系统内的前向纠错
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使用 Spartan-II 的 Reed-Solomon 解
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Virtex-4 FX 器件中的浮点单元 (FPU) 与 P
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Designing Efficient Digital Up
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