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FIFO Generator v2.2
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利用 EMIF 接口 Xilinx FPGA 和 TI DS
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使用DSP48 DDR 技术的Alpha Blending
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Forward Error Correction on IT
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A 3/4/5/6X Oversampling Circui
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Viterbi Decoder Block Decoding
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数字电视广播系统内的前向纠错
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使用 Spartan-II 的 Reed-Solomon 解
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Virtex-4 FX 器件中的浮点单元 (FPU) 与 P
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Designing Efficient Digital Up
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Decreasing Simulation Runtimes
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Using System Generator for Sys
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M2C-加速器简化了基于模型的设计
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AccelDSP IP 浏览器
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针对 DSP 使用 MATLAB 为系统生成器创建 IP
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AccelDSP 综合工具支持 MATLAB 结构和功能
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rtex 器件中的多个 CAM 设计概述
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Parameterizable 8b/10b Decoder
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Manchester Encoder-Decoder for
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利用 CoolRunner-II CPLD 设计 16b/2
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利用 CoolRunner CPLD 设计 16b/20b
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将 CoolRunner CPLD 用于智能卡读卡器应用
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利用 CoolRunner CPLD 实现串行 ADC 接口
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Virtex-II Pro FPGA 的性能与竞争 PLD
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高效的移位寄存器、LFSR 计数器和长伪随机序列发生器
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利用CoolRunner-II将计数器/定时器的分辨率加倍
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利用 SRL16E 节省成本
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Design Tips for HDL Implementa
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Correcting Single-Event Upsets
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