|
帖子主题 |
回复 |
人气 |
|
Spartan-3E/ 3 fpga 1:7反序列化速度高达
[Rancho]
|
0 |
2021 |
|
参考设计:Logicore OPB USB 2.0设备
[Rancho]
|
0 |
1604 |
|
在Spartan3E/ 3 fpga7:1序列化中速度高达6
[Rancho]
|
0 |
1725 |
|
使用现有的电缆建立下一代宽带网络基础设施
[Rancho]
|
0 |
1619 |
|
利用CoolRunner-II CPLD设计数码相机
[Rancho]
|
0 |
1446 |
|
色彩空间转换器:YCrCb - RGB
[Rancho]
|
0 |
1739 |
|
Chroma Resampler
[Rancho]
|
0 |
1670 |
|
二维列序滤波器 (Rank Order Filter)
[Rancho]
|
0 |
1756 |
|
Xilinx软件安装事项
[jhp79]
|
2 |
7050 |
|
ucf文件的编写
[baijunyan]
|
4 |
4927 |
|
ISE 的License问题
[baijunyan]
|
3 |
7138 |
|
FPGA助力中国智造,拥抱嵌入式计算新时代
[jackwang]
|
2 |
2462 |
|
Chroma Resampler
[Rancho]
|
0 |
1433 |
|
高密度算术函数实现的设计技巧
[Rancho]
|
0 |
1649 |
|
实现并转串,调试结果不对,找不到问题,请教大家
[minisnowy]
|
3 |
3337 |
|
FPGA编译ModelSim需要的Xilinx库
[jhp79]
|
1 |
2526 |
|
参考系统:决定 DDR 反馈时钟的最佳 DCM 相移
[Rancho]
|
1 |
2149 |
|
用 Xilinx CPLD 与 NAND Flash 存储器
[Rancho]
|
1 |
2257 |
|
FPGA实现高清信号的实时解码
[winthony]
|
0 |
1901 |
|
为什么Xilinx器件中BRAM大小是18K?
[jhp79]
|
0 |
5116 |
|
小调查:你对下面哪些FPGA器件感兴趣?
[lemonsky]
|
5 |
2830 |
|
Vivado 赛灵思最新设计开发套件
[winthony]
|
0 |
2469 |
|
高效的移位寄存器、LFSR 计数器和长伪随机序列发生器
[Rancho]
|
0 |
2232 |
|
将 DDR SDRAM 与 CoolRunner-II CP
[Rancho]
|
0 |
1888 |
|
利用 CoolRunner-II CPLD 和 SPI 闪存
[Rancho]
|
0 |
1954 |
|
无需板仿真即可估计实际的输出时序
[Rancho]
|
0 |
1920 |
|
133 MHz PCI-X 到128 MB DDR 小型 D
[Rancho]
|
0 |
1491 |
|
Virtex-5 系列高级封装
[Rancho]
|
0 |
1617 |
|
使用 Virtex-5 FPGA 器件实现 DDR SDRA
[Rancho]
|
0 |
2479 |