共1条
1/1 1 跳转至页
FPGA设计时如何减少占用的资源
首先看你对资源的定义,
通常的FPGAZH中,可以分为逻辑资源和布线资源。
显然你说的肯定是逻辑资源,其实还应该包括片内RAM(用ESB实现)
如果你是用VHDL或者Verilog这样的设计语言作为设计输入,你就应该看看
综合工具的HDL REFERNCE,这样可以写出更有利于综合软件优化的代码,
如果你用图形输入那末尽量采用公司提供的库元件。
如果你能用公司设计软件的专门语言如ALTERA-hdl,这样你可以更好的控制使用FPGA的资
源,因为这样你就可以真正使用和FPGA结构一样的primitve.
从长远和有效的方法来看,还是努力提高HDL 编码水平吧。
当然综合时一些属性和参数的设计也可以帮助你提高利用率。
关键词: 计时 如何 减少 用的 资源
共1条
1/1 1 跳转至页
回复
有奖活动 | |
---|---|
【有奖活动】智能可穿戴设备AR/VR如何引领科技新潮流! | |
奖!发布技术笔记,技术评测贴换取您心仪的礼品 | |
【有奖活动】震撼来袭!这场直播将直击工程师的心灵! | |
“我想要一部加热台”活动,不花钱赢取开发好工具!活动开始了哦 | |
【有奖活动】伙伴们:您的“需求”解决了吗? |
打赏帖 | |
---|---|
老胖子聊电路--分析一个反馈电路被打赏50分 | |
放大↔震荡被打赏50分 | |
【换取手持数字示波器】RTduino驱动ssd1306+sht31温湿度计被打赏40分 | |
【换取手持数字示波器】称植国产开源TobudOS到雅特力AT32F425被打赏40分 | |
【分享评测,赢取加热台】+Telink-泰凌微电子B91点灯篇被打赏20分 | |
【换取手持数字示波器】+精英板驱动LCD屏被打赏50分 | |
【换取手持数字示波器】+DFR0216全彩灯带WS2812示例分享被打赏50分 | |
【换取手持数字示波器】安装雅特力国产IDE-AT32IDE被打赏30分 | |
【换取手持数字示波器】+DFR0654板卡驱动数码管和串口功能分享被打赏50分 | |
【换取手持数字示波器】+DFPlayerMini模块推喇叭示例分享被打赏50分 |