请问诸位大虾,s3c44b0在引导过程中PLL和Clock的寄存器如何设置?
PLLCON中MDIV,PDIV,SDIV的值以及含义
CLKCON,CLKSLOW,LOCKTIME类似的,请大虾解释下各bit组的取值及含义。
不甚感激。
[em01]斑竹请看代码:
[code]
;以下三段设置时钟控制寄存器
ldr r0,=LOCKTIME
ldr r1,=0xfff
str r1,[r0]
[ PLLONSTART
ldr r0,=PLLCON ;temporary setting of PLL
ldr r1,=((M_DIV<<12)+(P_DIV<<4)+S_DIV) ;M_DIV=52 P_DIV=3
;S_DIV=1
str r1,[r0]
]
ldr r0,=CLKCON
ldr r1,=0x7ff8 ;All unit block CLK enable
str r1,[r0]
[/code]
三星手册只是说PLLCON是PLL configuration reg,reset value=0x38080
但代码中的值与reset value不一样,不知这个值如何得来。
所以恳请斑竹多给点解释。
问题如下:
1.何时开启锁相环?(PLLONSTART)或者说开启与否有何区别?
2.这些register的意义是什么?有什么用?
(三星的手册只是解释了它们的名称,但作用是什么)
3.这些register的值如何设定?(手册提到要根据连接的ram来定,是吗?)
能不能来个例子解释一下。
4.PLL和CLOCK共有4个reg,CLKSLOW为何不用设置?
(同样的问题是为什么PLL和CLOCK要设置,其中又有哪些reg需要设置。)
小弟初学,问题很多,又喜欢刨根问底,硬件知识缺乏。
望大虾不吝赐教。
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