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LatticeMachXO2控制开发板的特性及原理图
船长demons
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无厘头
2020-01-23 18:52:56
转发“Verilog HDL高级数字设计(第2版)(英文版)_[M D.Ciletti 著][Prentice Hall][2010][984页]”
【FPGA/CPLD】
SYD2012
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浏览:27853
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dsbssb
2019-11-25 21:54:23
黑金板什么办法把HDMI的视频转入到硬件的显示屏上?
bajuntu
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浏览:809
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bajuntu
2019-08-18 11:56:09
黑金板什么办法把HDMI的视频转入到硬件的显示屏上?
bajuntu
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bajuntu
2019-08-04 09:08:17
国产fpga芯片基于JTAG接口的UserFlash烧写方法(GW1N-1&GW1N-1S)
lattice001
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lattice001
2019-07-29 14:46:51
Verilog HDL语言编程的误区与经验
无厘头
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卢风
2019-07-15 12:39:56
给VHDL/Verilog的初学者的一些实用建议
无厘头
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卢风
2019-07-15 12:39:41
chipscope 报错
bajuntu
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bajuntu
2019-07-10 09:04:20
德州仪器量产全球首款90纳米1GHz DSP
【DSP系统】
madet
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邾城君8891
2019-06-25 14:37:48
回顾那些年学过的数模电,用Python打开新思路
【FPGA/CPLD】
wensha0341
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a1622240060
2019-05-21 16:51:34
【应用笔记】Cyclone II器件和DDR及DDR2 SDRAM的接口(Interfacing DDR & DDR2 SDRAM with Cyclone I
【FPGA/CPLD】
bobgeng
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dengtuandy
2019-05-14 21:24:12
好书推荐《VerilogHDL硬件描述语言》pdf档
【FPGA/CPLD】
HXW718059156
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浏览:10336
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hlhh1013
2019-04-23 11:08:41
请教一下,chip planner中的LCCOMB是LAB的意思吗?
【FPGA/CPLD】
htbadboy
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xzyee
2019-04-16 21:21:25
求助: 用vhdl或者verilog 实现modbus协议,求代码啊?
【FPGA/CPLD】
luokuing
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dimple001
2019-03-27 17:02:41
中文文章:怎样写testbench(xilinx的)
【FPGA/CPLD】
叮叮当当
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lixl0918
2018-12-19 14:04:57
Vivado Hls 设计流程总结
【FPGA/CPLD】
L周O逗V逗E
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浏览:1705
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fbsdfb
2017-11-07 23:20:29
RAM—based shift register如何设置
【FPGA/CPLD】
WZH702461
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浏览:4382
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walkmen1990
2017-09-01 14:14:24
求4位直插拨码开关的datasheet.
【FPGA/CPLD】
happysheep
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浏览:7489
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kingtek
2017-08-03 14:19:55
VHDL编程的一些心得体会
【FPGA/CPLD】
L周O逗V逗E
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浏览:1701
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L周O逗V逗E
2017-06-29 14:42:39
VHDL常用代码
【FPGA/CPLD】
damifans
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damifans
2017-06-29 14:15:10
VHDL测试文件写法
【FPGA/CPLD】
dasdzxc
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dasdzxc
2017-06-29 14:12:49
ZYNQ学习笔记(一) HelloWorld实现
【FPGA/CPLD】
hedibn012
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hedibn012
2017-06-29 13:31:55
Vivado Hls 设计流程总结
【FPGA/CPLD】
L周O逗V逗E
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L周O逗V逗E
2017-06-28 16:15:31
在Vivado Hls中,数据类型的转化分析
【FPGA/CPLD】
L周O逗V逗E
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浏览:2199
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L周O逗V逗E
2017-06-28 16:14:25
在Vivado Hls中,数据类型的转化分析
【FPGA/CPLD】
L周O逗V逗E
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L周O逗V逗E
2017-06-28 16:09:17
详解python的几种标准输出重定向方式
【FPGA/CPLD】
WZH702461
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WZH702461
2017-06-28 15:09:37
ZYNQ平台的HDMI驱动测试
【FPGA/CPLD】
hongweidt102
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hongweidt102
2017-06-28 14:24:03
ISE+Planahead Virtex5 FPGA部分可重构流程示例
【FPGA/CPLD】
littleshrlmp
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vaioshop
2017-06-27 21:38:02
Verilog的testbench入门
【FPGA/CPLD】
littleshrlmp
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littleshrlmp
2017-06-27 16:56:47
用VHDL/VerilogHD语言开发PLD/FPGA的完整流程VHDL实例
【FPGA/CPLD】
wllaodage
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wllaodage
2017-06-27 15:10:25
Choosing FPGA or DSP for your Application
【FPGA/CPLD】
cqa29
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cqa29
2017-06-27 14:58:33
FPGAs: the high-end alternative for DSP application
【FPGA/CPLD】
cqa29
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cqa29
2017-06-27 14:57:07
怎么操作xc7k325通过RS422在线升级FLASH?
【FPGA/CPLD】
龙山电工
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龙山电工
2017-06-27 13:56:15
【时序约束】关于设置FALSE PATH
【FPGA/CPLD】
100dongdong
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100dongdong
2017-06-27 13:51:51
关于Lattice的CPLD烧录问题(ispMACH 4000V)
【FPGA/CPLD】
ele268
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a417691286
2017-06-21 18:06:17
CCS中Graph不得不知道的8点
【DSP系统】
wangying
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ssss1989
2017-05-26 22:14:23
小弟刚刚学习VHDL语言大家能帮忙看看这段代码哪里错了吗
【FPGA/CPLD】
pangsg
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vaioshop
2017-05-22 08:39:19
赛灵思自曝八大秘笈(2): 用V7GTH的自驱动能力简化评估链路性能
【FPGA/CPLD】
wangying
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anytao
2017-03-24 20:04:25
FPGA外部配置flash(存储器)的多余空间使用
【FPGA/CPLD】
枯藤
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枯藤
2017-03-03 15:47:11
求助关于GTH/GTX问题
【FPGA/CPLD】
shabbylife
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shabbylife
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