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Xilinx FPGA SOC ERROR1 解决方案

工程师
2015-01-28 12:27:10     打赏
 ERROR:
[NgdBuild 604] logical block 'system_iipscope_axi_monitor_0ipscope_axi_monitor_0/U_ILA' with type 'chipscope_axi_monitor_0' could not be resolved. A pin name misspelling can cause this, a missing edif or ngc file, case mismatch between the block name and the edif or ngc file name, or the misspelling of a type name. Symbol 'chipscope_axi_monitor_0' is not supported in target 'zynq'.

解决方案:
1. Removed directory .src/sources_1/edk//implementation
2. Removed directory .src/sources_1/edk//synthesis
3. Created new synthesis and implementation runs.
4. Set the new runs as "active".
5. Removed old runs.
6. Opened XPS by double-clicking in the embedded design under the sources tab.
7. Closed XPS without doing anything.
8. Selected the new synthesis run and clicked on "Reset Selected Runs".
9. Selected the new implementation run and clicked on "Launch Selected Runs". 

菜鸟
2015-01-28 13:49:05     打赏
2楼
学习了

菜鸟
2015-01-28 14:20:51     打赏
3楼
谢谢楼主

菜鸟
2015-01-28 14:46:34     打赏
4楼
学习了,顶

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