网站首页
这些小活动你都参加了吗？快来围观一下吧！>>
电子产品世界 » 论坛首页 » 综合技术 » 物联网技术 » 把电路设计成低阻抗，可以有效的降低噪声对电路的影响

共2条 1/1 1 跳转至页

把电路设计成低阻抗，可以有效的降低噪声对电路的影响

ddo19871222
菜鸟
2011-10-09 14:47:52     打赏
今天在一本书上看到这样一句话：把电路设计成低阻抗，可以有效的降低噪声对电路的影响，因为噪声源大多是高内阻的，有没有哪位大侠对上面这句话解释一下，为什么这样可以降低噪声的影响，
回复
收藏
0



关键词： 电路设计     成低     阻抗     可以     有效     降低     噪声     电路    

ddo19871222
菜鸟
2011-10-09 15:31:52     打赏
2楼

谢谢，不过我对VN的公式有点不明白，
1、公式计算出来的VN是电阻在电路中产生的干扰，还是电阻对外部干扰做出的反应呢，
2、楼上的解释是不是说的是降低R减少了信号源在电阻上的产生的干扰？


评论
共2条 1/1 1 跳转至页

回复

匿名不能发帖！请先 [ 登陆 注册 ]