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请教关于allegro VIA及焊盘制作

菜鸟
2013-06-17 16:11:17     打赏

在allegro中制作VIA的时候,只有begin layer default internal layer 和 end layer

但是从网上下多层板里,每个VIA又都包含了 POWER GND 甚至是其他信号层的定义。

VIA中这些POWER GND 甚至信号层的定义,是应该在一开始就定义的吗?如果是这样,通用性岂不是很差?

如果不是,而是将只包含begin internal end的VIA加进去之后,再修改的话,又是如何修改的呢?是在padstack处修改吗?

请各位指点




关键词: 请教     关于     allegro     焊盘     制作    

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