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请教关于allegro VIA及焊盘制作

asdf1143
菜鸟
2013-06-17 16:11:17     打赏

在allegro中制作VIA的时候，只有begin layer default internal layer 和 end layer

但是从网上下多层板里，每个VIA又都包含了 POWER GND 甚至是其他信号层的定义。

VIA中这些POWER GND 甚至信号层的定义，是应该在一开始就定义的吗?如果是这样，通用性岂不是很差?

如果不是，而是将只包含begin internal end的VIA加进去之后，再修改的话，又是如何修改的呢?是在padstack处修改吗?

请各位指点

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关键词： 请教     关于     allegro     焊盘     制作    

flyingone
菜鸟
2013-06-17 16:50:58     打赏
2楼
如果不定义vcc gnd，internal 层就是默认的，其他层都是用这个的。

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flyingone
菜鸟
2013-06-17 16:51:09     打赏
3楼
你可以直接把gnd vcc层删掉就可以的，

评论
李雪峰
高工
2013-06-18 09:18:58     打赏
4楼

水平很高呢


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winthony
工程师
2013-06-18 11:30:56     打赏
5楼

看你的习惯，一般不用单独定义，就用默认的内层就可以了

 


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