在allegro中制作VIA的时候,只有begin layer default internal layer 和 end layer
但是从网上下多层板里,每个VIA又都包含了 POWER GND 甚至是其他信号层的定义。
VIA中这些POWER GND 甚至信号层的定义,是应该在一开始就定义的吗?如果是这样,通用性岂不是很差?
如果不是,而是将只包含begin internal end的VIA加进去之后,再修改的话,又是如何修改的呢?是在padstack处修改吗?
请各位指点
我要赚赏金打赏帖 |
|
|---|---|
| 【S32K3XX】LPSPI参数配置说明被打赏¥21元 | |
| 在WT9932C61-TINY上实现超声波测距被打赏¥22元 | |
| 基于WT9932C61-TINY的环境构建及OLED屏驱动测试被打赏¥20元 | |
| 【S32K3XX】Core-to-Core 中断使用被打赏¥21元 | |
| 「AI编程记录--含源码」用一晚上的时间写一个esp32的示波器被打赏¥19元 | |
| STM32C0116DK开发探索记(3)被打赏¥30元 | |
| STM32C0116DK开发探索记(2)被打赏¥24元 | |
| STM32C0116DK开发探索记(1)被打赏¥29元 | |
| 谨防极海G32M3101电机评估板易跌落的陷阱被打赏¥24元 | |
| 【全网首拆】M5STACK ATOM系列开发板拆解 / AtomS3R-CAM摄像头更换方法(提高10倍像素)被打赏¥26元 | |