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FPGA顶模块调用的子模块比较多时，是在XPS里生成顶模块IP么？可以在planahead里将我的FPGA代码放在system_slut.v下面作为它的子模块么

simonmao8385
高工
2014-02-17 10:48:24     打赏
麻烦问大家一个问题，FPGA顶模块调用的子模块比较多时，是在XPS里生成顶模块IP么？可以在planahead里将我的FPGA代码放在system_slut.v下面作为它的子模块么？？？麻烦大家了。不清楚FPGA代码在里面怎么开发，求大神指点！
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关键词： Xilinz     FPGA    

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