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电子产品世界 » 论坛首页 » 嵌入式开发 » FPGA » 这种情况下，DSP和FPGA的时钟信号如何产生呢？

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这种情况下，DSP和FPGA的时钟信号如何产生呢？

白岭
工程师
2020-02-23 22:38:09     打赏
我做的一个基于DSP的系统中，DSP做主处理器，控制着整个系统，包括信号处理，整体调度等；选择了一块Xilinx的FPGA做FIFO UART和系统的逻辑控制和译码。DSP的时钟输入为15MHz,经过内部的PLL倍频为较高频率，FPGA需要25M或一下的时钟输入。

我的问题是：这种情况下，DSP和FPGA的时钟信号如何产生呢？


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关键词： DSP     FPGA     时钟     时钟信号     Xilinx    

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