网站首页
这些小活动你都参加了吗？快来围观一下吧！>>
电子产品世界 » 论坛首页 » 嵌入式开发 » FPGA » 这种情况下，DSP和FPGA的时钟信号如何产生呢？

共4条 1/1 1 跳转至页

这种情况下，DSP和FPGA的时钟信号如何产生呢？

白岭
工程师
2020-02-23 22:38:09     打赏
我做的一个基于DSP的系统中，DSP做主处理器，控制着整个系统，包括信号处理，整体调度等；选择了一块Xilinx的FPGA做FIFO UART和系统的逻辑控制和译码。DSP的时钟输入为15MHz,经过内部的PLL倍频为较高频率，FPGA需要25M或一下的时钟输入。

我的问题是：这种情况下，DSP和FPGA的时钟信号如何产生呢？


回复
收藏
0



关键词： DSP     FPGA     时钟     时钟信号     Xilinx    

明月风
工程师
2020-02-23 22:45:29     打赏
2楼

如果可以是否影响时钟信号的质量？


评论
从小就是电子迷
工程师
2020-02-23 22:52:33     打赏
3楼

如果分别用一块晶振的话，对真个系统的时序控制是否会有影响？


评论
能力就是实力
工程师
2020-02-23 23:00:07     打赏
4楼

我觉得吧，不用缓冲时不行的，回带来很多意想不到的后果，建议加个时钟芯片！


评论
共4条 1/1 1 跳转至页

回复

匿名不能发帖！请先 [ 登陆 注册 ]
站长统计
×

Digikey let's do
· 2025年第1期限时报名开启，5月8日截止
· Digikey助力，提供一站式免费器件支持
· 跟大佬一起 【DIY 功率监测与控制系统】