本人FPGA初学者ISE quartus 都用过,今天参加这次活动还希望大家多多支持,有什么说的不对或欠妥的地方,也请大家帮忙指出。
首先我先谈谈我对Robei软件的第一印象:
1、小巧玲珑,便于携带:如果某一天能够拿着IPAD,在地铁公交上设计FPGA那个软件必然是Robei(或者他儿子)。4M安装,装完之后才不到10M,感慨惊叹之际不仅有些怀疑他的功能 ;
2、界面简洁、美观舒服:就像电子产品世界论坛一样,进入Robei给你的第一印象是舒服。
没有繁多的工具条(Modelsim),不会使人产生望尘莫及很深奥的感觉;
没有过多的窗口(Modelsim),不会使人产生需要先找教程的第一印象;
没有很土鳖的界面(quartus8.0),不会使人产生低端落伍的感受;
没有复杂的操作(Modelsim,ISE),不会使人产生望而生畏的感觉;
3、图形输入、易学易懂:对初学者来说图形输入是很有必要的,他不但能帮助我们理清思路方便设计,还能够省去模块例化、模块调用上语言的障碍。
先写这些,陆续更新,如有错误,还望赐教
lidonglei1 Robei FPGA进程贴


2楼
。。。。论坛发帖这样啊,我上边打的那些都是拍过版的,很多排比句我都是分行写的,个个小点也是分开写的,怎么发完之后便成一坨了。。。求指导!


5楼
第二贴:感受、建议(针对2.1未注册版)
1、右键功能缺乏:没有右键工具条,ISE,quartus里边原理图输入时都有右键工具,这样可以方便快捷地找到工具。
2、放大缩小没有快捷键:ISE里是F7和F8,距离太远有些不顺手;quartus在波形输入时放大缩小好像是ctrl+shift+空格(好像是),也不太顺手;原理图和波形最好有靠近左手的快捷键,不用来回点来点去。(本人dotaer,对这个比较敏感,呵呵)
3、保存完成好像是一个model的工程文件,不利于之后的时序仿真,如果能在原理图输入过程中将原理图生成HDL语言文件方便之后移植到ISE、modelsim等软件,那就太IMBA了
4、直接逻辑电平01的连接,记得刚学EDA时用quartus的原理图输入直接把0接到地把1接到vcc特别方便。。。。
1、右键功能缺乏:没有右键工具条,ISE,quartus里边原理图输入时都有右键工具,这样可以方便快捷地找到工具。
2、放大缩小没有快捷键:ISE里是F7和F8,距离太远有些不顺手;quartus在波形输入时放大缩小好像是ctrl+shift+空格(好像是),也不太顺手;原理图和波形最好有靠近左手的快捷键,不用来回点来点去。(本人dotaer,对这个比较敏感,呵呵)
3、保存完成好像是一个model的工程文件,不利于之后的时序仿真,如果能在原理图输入过程中将原理图生成HDL语言文件方便之后移植到ISE、modelsim等软件,那就太IMBA了
4、直接逻辑电平01的连接,记得刚学EDA时用quartus的原理图输入直接把0接到地把1接到vcc特别方便。。。。



1、右键功能缺乏:没有右键工具条,ISE,quartus里边原理图输入时都有右键工具,这样可以方便快捷地找到工具。
::这样的设计是为了跟平板电脑统一。平板电脑上你没有右键可用。同时,该方式不会隐藏操作,所见所得,不会让用户觉得哪里藏了项目找不到。
2、放大缩小没有快捷键:ISE里是F7和F8,距离太远有些不顺手;quartus在波形输入时放大缩小好像是ctrl+shift+空格(好像是),也不太顺手;原理图和波形最好有靠近左手的快捷键,不用来回点来点去。(本人dotaer,对这个比较敏感,呵呵)
::放大所有都有快捷键的,可能跟你用的有点不同。是CTRL和+放大,CTRL和-缩小。波形图也有放大缩小快捷键。
3、保存完成好像是一个model的工程文件,不利于之后的时序仿真,如果能在原理图输入过程中将原理图生成HDL语言文件方便之后移植到ISE、modelsim等软件,那就太IMBA了
::Robei软件的优势就是可以直接将图形化设计转成verilog代码,可以直接放到ISE、modelsim等软件里面调用。你用了注册版就知道了,还可以仿真。
4、直接逻辑电平01的连接,记得刚学EDA时用quartus的原理图输入直接把0接到地把1接到vcc特别方便。。。。
::Robei开始设计不是针对原理图。不过可以考虑增加原理图功能。

10楼
软件用的不是很熟练,连了半天(想起了一位大神说的:大的系统用原理图输入会累死你的)
先上传这些(总工程一部分)
顶层文件led_dis,实现功能4位数码管依次12345.。。。点亮
源码是VHDL的不能输入(这东西简单也没必要。。)
led_dis.rar
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