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DAC 急求帮忙:DAC后仿不成功的原因?
问
我做了一个10bits 时钟频率为50MHZ的DAC,低四位采用二进制编码,高六位采用hot code,分成3+3结构,经编码后构成一个8*8的矩阵阵列,前仿时功能正确,后仿时用calibre单纯提取C时功能是正确的,但是提取RC时功能就不正确了,这样是否说明版图寄生电阻比较大?产生这样问题的原因是什么?由于电路中既有模拟部分,又有数字部分,在画版图时,特别要注意的是什么?
答 1: 具体分析才知道从你的描述看,似乎是寄生电阻造成的影响。但R和C的影响是交织在一起的,只有具体分析了以后才能下结论。
你提到的版图问题,一些一般的原则是:模拟部分和数字的部分的电源/地最好分开、电流镜注意匹配(常常利用dumy形成电流镜矩阵)…… 答 2: 多谢回复多谢着为仁兄的指点,这些问题,我都注意到了,现在已经将版图的模拟部分和数字部分分开画了,似乎还是不理想,就是将编码,锁存以及开关分成三个矩阵,效果是否会好呢? 答 3: 编码和锁存一般不用刻意画成矩阵编码和锁存一般不用刻意画成矩阵,其版图要求相对较低。开关最好和电流镜矩阵配合画。
功能不正确的问题一定要解决,性能不理想的问题则是尽量优化。两者要区分。
版图设计象是做艺术家,没有最好。关键是达到所需要的性能要求就可以了。 答 4: 控制开关前的buffer影响到底有多大?我将编码和锁存分开程不同的矩阵的目的是,想让时钟受信号线的影响小些,目前后仿结果看来,好像不明显,尝试了一个将控制开关的buffer的电源和地单独供,就是单拉出引脚来供电源和地,好像效果很明显;
如果buffer的电源和地与其他模拟电源相连接的话,毛刺很小,8mv多,但是最终的输出还是不对,也就是最终的输出毛刺大到了影响正常功能的幅值,楼上的仁兄能否帮我再解答一下,多谢了!
答 1: 具体分析才知道从你的描述看,似乎是寄生电阻造成的影响。但R和C的影响是交织在一起的,只有具体分析了以后才能下结论。
你提到的版图问题,一些一般的原则是:模拟部分和数字的部分的电源/地最好分开、电流镜注意匹配(常常利用dumy形成电流镜矩阵)…… 答 2: 多谢回复多谢着为仁兄的指点,这些问题,我都注意到了,现在已经将版图的模拟部分和数字部分分开画了,似乎还是不理想,就是将编码,锁存以及开关分成三个矩阵,效果是否会好呢? 答 3: 编码和锁存一般不用刻意画成矩阵编码和锁存一般不用刻意画成矩阵,其版图要求相对较低。开关最好和电流镜矩阵配合画。
功能不正确的问题一定要解决,性能不理想的问题则是尽量优化。两者要区分。
版图设计象是做艺术家,没有最好。关键是达到所需要的性能要求就可以了。 答 4: 控制开关前的buffer影响到底有多大?我将编码和锁存分开程不同的矩阵的目的是,想让时钟受信号线的影响小些,目前后仿结果看来,好像不明显,尝试了一个将控制开关的buffer的电源和地单独供,就是单拉出引脚来供电源和地,好像效果很明显;
如果buffer的电源和地与其他模拟电源相连接的话,毛刺很小,8mv多,但是最终的输出还是不对,也就是最终的输出毛刺大到了影响正常功能的幅值,楼上的仁兄能否帮我再解答一下,多谢了!
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