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用VHDL怎么表示ram 从rom里面读数据读满了或者写满了啊
【FPGA/CPLD】
站的高尿的远
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dreamjsc
2011-10-26 11:14:02
秀秀我购买的MSP430 LaunchPad开发板开发板
【DSP系统】
筱爱
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HXW718059156
2011-10-11 22:30:35
ddr2 high performace controller的使用
【FPGA/CPLD】
gmy2171
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wjason11
2011-09-22 11:18:40
内嵌逻辑分析仪SignalTapII教程
【FPGA/CPLD】
dreamjsc
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dreamjsc
2011-09-20 16:19:03
怎么用protel手工给DDR布等长线
【FPGA/CPLD】
happysheep
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happysheep
2011-09-20 15:07:57
关于systemverilog的testbench
【FPGA/CPLD】
多情贱客无情贱
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mjei
2011-09-15 22:08:05
Linux下PDU通信的设置非阻塞模式
【DSP系统】
halibote523
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jackwang
2011-09-15 08:11:10
modelsim工程步骤不知对否
【FPGA/CPLD】
站的高尿的远
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dreamjsc
2011-09-13 10:29:29
Error: CONF_DONE pin failed to go high in device 1
【FPGA/CPLD】
happysheep
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datao1225
2011-08-31 09:42:39
前沿的DSP:davinci 的Linux应用
【DSP系统】
halibote523
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halibote523
2011-08-30 14:11:37
verilog文件读写教程(共享)
【FPGA/CPLD】
Jason_Zhang
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jlyun2069
2011-08-29 20:09:03
Win7下Quartus 11安装ByteBlaster II驱动的方法
【FPGA/CPLD】
impw
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electronstar
2011-08-28 22:45:46
SN74ALVC164245与74LVT16245芯片的区别
【FPGA/CPLD】
hasea
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hasea
2011-08-24 17:51:41
Synplify工具使用指南_华为文档
【FPGA/CPLD】
Jason_Zhang
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duqiheng86
2011-08-23 08:06:50
基于matlab的dsp调试技术
【DSP系统】
abbing
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lin8921740
2011-08-22 14:27:30
pwm Verilog 程式
【FPGA/CPLD】
jeffreychen
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dreamjsc
2011-08-14 10:14:40
求助:用CPLD产生脉冲,不知道怎么着手啊
【FPGA/CPLD】
271303204
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jeffreychen
2011-08-09 23:34:21
modelsim 6.b 仿真的问题
【FPGA/CPLD】
duqiheng86
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linuxp
2011-08-05 22:11:48
用vhdl语言描述的正弦波数字数字频率及记
【FPGA/CPLD】
nightbreeze
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nightbreeze
2011-08-04 16:57:45
altera PLL User Guide(分享)
【FPGA/CPLD】
Jason_Zhang
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touhousama
2011-08-01 22:43:01
[原创]Modelsim仿真Altera的ROM时Failed to open hex file的解决方法
【FPGA/CPLD】
Jason_Zhang
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ernesto1209
2011-07-29 21:56:38
[分享]4篇Altera中文资料
【FPGA/CPLD】
叮叮当当
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ernesto1209
2011-07-28 21:10:57
转让几乎全新ALTERA公司DE2-70开发板,2400元
【FPGA/CPLD】
suchangqing
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pogulu
2011-07-26 13:44:44
verilog设计的一点经验
【FPGA/CPLD】
tingzi
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glxxgl
2011-07-23 19:36:32
Xilinx ISE 10.1深入辅导资料(分享)
【FPGA/CPLD】
Jason_Zhang
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waters1006
2011-07-23 18:42:59
【急求解答】ERROR:CONF_DONE pin failed to go high in device 1(Quartus II)(EP2S15)
【FPGA/CPLD】
humorking
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humorking
2011-07-20 22:12:41
Verilog question
【FPGA/CPLD】
jeffreychen
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dreamjsc
2011-07-19 15:12:11
同时 32个 30MHz CLK 同时动作 !!
【FPGA/CPLD】
jeffreychen
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antonine
2011-07-18 19:17:16
键盘消抖电路:miss source signal
【FPGA/CPLD】
blueskyliu
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CRRBravery
2011-07-14 15:54:21
DSP和CPLD的宽带信号源的设计方案
【DSP系统】
BlackcatIC
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GogogoTop
2011-07-08 17:41:26
【TI技术文章】:TI KeyStone架构支持L2及传输处理
【DSP系统】
DSP新天地
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DSP新天地
2011-07-05 10:05:29
[精华]
verilog怎么编译不过啊?
【FPGA/CPLD】
风语者
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jlyun2069
2011-06-22 16:51:26
synplify的优点?
【FPGA/CPLD】
becoll
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jlyun2069
2011-06-22 16:23:05
常用行业软件License设置方法(转)
【FPGA/CPLD】
Jason_Zhang
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jlyun2069
2011-06-22 16:22:34
Verilog代码书写规范
【FPGA/CPLD】
Jason_Zhang
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jlyun2069
2011-06-22 16:19:45
VerilogHDL及其Testbench编写方法
【FPGA/CPLD】
Jason_Zhang
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502593045
2011-06-07 13:26:57
TI技术文章:TMS320TCI6618-TI 高性能LTE 物理层解决方案
【DSP系统】
DSP新天地
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DSP新天地
2011-06-02 14:45:42
Xilinx开放源码硬件大赛培训教材,需要的进来申请
【FPGA/CPLD】
jackwang
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Ottomia
2011-05-30 21:59:01
Setup Relationship 与 Tsu Requirement 的区别
【FPGA/CPLD】
FPGAVHDLARM
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tl1116
2011-05-25 14:57:16
Counter use rising & falling clock
【FPGA/CPLD】
jeffreychen
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Jason_Zhang
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