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如何成为高级会员啊？？？ zhaixw2008\|浏览：1291\|回复：1\| 熊猫爱善 2018-05-11 07:48:57
请问有做过SDI OVER IP设计的吗【Zynq】 csloner\|浏览：1648\|回复：1\| 熊猫爱善 2018-05-11 07:47:04
关于fpga设计中的异步双时钟切换【软件智能】蘑菇有独\|浏览：1948\|回复：0\| 蘑菇有独 2018-04-04 10:45:11
【Nexys3】难得的数字电路实验原始工程文件_Lab15_sw2reg.rar 583199723\|浏览：7612\|回复：20\| sinamyth 2018-03-28 21:51:07
ubuntu16.04 安装 vivado 后无法再vivado中启动SDK，求大神解答？【Zynq】 whitesnark\|浏览：7364\|回复：2\| mli59 2018-02-22 12:05:12
请教如何计算器件的D触发器数量【软件智能】 bucker\|浏览：1601\|回复：0\| bucker 2018-01-24 18:38:38
Synthesis going Out-of-Date for Unrelated Changes EEPW干货喵\|浏览：2554\|回复：1\| 熊猫爱善 2018-01-23 10:13:00
How to Constrain Clock Interactions correctly EEPW干货喵\|浏览：1996\|回复：1\| 熊猫爱善 2018-01-23 10:11:55
usb_verilog 有很详细的英文说明，外添一份大连理工的论文，一起看包你完全理解usb,最后是usb_jtag 的verilog状态机 dongzhiL332\|浏览：5288\|回复：9\| GUIWENJING 2017-12-25 10:11:12
zynq的FCLK_clk0无输出，请问是什么原因？【Zynq】 maxwell1015\|浏览：3968\|回复：0\| maxwell1015 2017-12-22 14:09:55
SPARTAN 3AN系列 excel footprint xiaolin4006\|浏览：1405\|回复：0\| xiaolin4006 2017-12-18 21:31:47
国外一大学的SPARTAN-3E开发板的实验例子（含代码很经典） jiangnanyu\|浏览：17415\|回复：46\| cuiapei 2017-12-07 21:06:22
请问用过Spartan6系列的产生的MIG的吗？MIG产生的源代码只能是verilog吗？可以选择VHDL吗？ tanyushuang727\|浏览：2595\|回复：1\| jhy222222 2017-11-22 19:59:54
zynq调试MMU section translation fault 【Zynq】 piqiuarm\|浏览：3579\|回复：0\| piqiuarm 2017-10-23 13:27:14
V3学院杯开发大赛【ZingBoard开发手记】 zhaocheng2006\|浏览：1679\|回复：2\| eepwnet 2017-10-17 14:07:49
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求助irda红外 SIR 协议的发送接收 VHDL设计【Zynq】 xiaozhengzheng\|浏览：1717\|回复：0\| xiaozhengzheng 2017-09-03 22:14:33
书上第一个实验我的超级终端显示的不太对 simonmao8385\|浏览：1861\|回复：2\| machinnneee 2017-07-31 16:06:56
V3学院杯：全可编程SoC嵌入式系统设计大赛 eepwnet\|浏览：1563\|回复：3\| machinnneee 2017-06-20 08:34:17
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求助xilinx spartan6 倍频的方法 xilinxeepw\|浏览：7984\|回复：9\| liweisdut 2017-03-07 15:38:01
vivado 程序有相应的 com/ole/activeX 程序访问进程吗？【软件智能】 dinggaofei\|浏览：1845\|回复：2\| 熊猫爱善 2017-03-01 12:22:16
zynq中的DDR3写入问题，求解【Zynq】 fanrizhao\|浏览：3374\|回复：1\| fanrizhao 2017-02-09 16:49:34
FIR Compiler IP Core问题求助 wwmumu\|浏览：18445\|回复：21\| sanbaiqian 2017-01-18 15:16:48
xilinx.com官网论坛如何发帖【Zynq】 wjxboy\|浏览：1378\|回复：0\| wjxboy 2016-12-13 23:47:56
EK-Z7-ZC706-G 使用的问题如何处理【Zynq】 wjxboy\|浏览：2685\|回复：2\| vaioshop 2016-12-07 08:28:23
ISE和modelsim联合仿真时，出现这个问题，该怎么解决啊【软件智能】借鉴A学习者B\|浏览：3584\|回复：0\| 借鉴A学习者B 2016-11-25 13:13:08
请问是否可以通过labview开发任何一款XILINX的fpga啊？【ZYNQ开发板申请】 wangjiahao88\|浏览：2355\|回复：1\| 未羊 2016-11-19 19:37:30
求问VHDL如何能生成随机数 shabbylife\|浏览：2998\|回复：1\| machinnneee 2016-10-28 17:54:08
为什么edk调试时出现 No Source Available for "main()" zynq\|浏览：4328\|回复：1\| talentx 2016-09-21 16:00:06
Xilinx收购Auviz Systems，FPGA与GPU之战终于要开始了【软件智能】 Ameya360\|浏览：2137\|回复：1\| machinnneee 2016-09-08 15:24:22
这个问题怎么解决呢少静\|浏览：2216\|回复：2\| 少静 2016-08-12 11:20:46
没有什么方式可以实现外部到内部DMA（S2MM)的连续传输 simonmao8385\|浏览：2347\|回复：1\| lolo84 2016-08-09 10:21:23
zedboard的PL怎么做串口读写啊 seeker\|浏览：8913\|回复：1\| lolo84 2016-08-09 10:15:57
请问7015上的gtp和hr是什么? legend198908\|浏览：2468\|回复：1\| lolo84 2016-08-09 10:05:23
请问vdma在往ddr里面传输完第一次数据遇到的问题站的高尿的远\|浏览：3154\|回复：1\| lolo84 2016-08-09 09:53:37
请问vdma传递完一帧数据，是如何传递下一帧数据的？？？axi-stream4发起什么信号啊？？站的高尿的远\|浏览：3246\|回复：1\| lolo84 2016-08-09 09:45:06
zynq中如何从gp取数据放到FIFO中【Zynq】 qianrenrui\|浏览：6353\|回复：3\| lolo84 2016-08-05 12:52:47
怎么用PL去读DDR啊？西门\|浏览：2947\|回复：1\| lolo84 2016-08-05 12:47:43
我想使用I2c接口，这样应该怎么创建一个双向IO口呢？ leo\|浏览：2704\|回复：1\| lolo84 2016-08-05 12:43:35

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