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VIVADO导出硬件时没有export hardware for sdk选项【Zynq】 Yker\|浏览：10798\|回复：4\| 赵奇 2019-06-12 23:03:17
请教各位大大Could not find a valid device tree怎么破【Zynq】 yousuozi\|浏览：9088\|回复：1\| 水方 2019-06-03 21:50:58
XC6SLX16内部是否可被加密【Zynq】 nahlj\|浏览：3787\|回复：0\| nahlj 2019-05-04 14:53:48
请问各位zynq PL端如何读写ddr啊？？ simonmao8385\|浏览：9517\|回复：2\| melau 2019-04-12 15:52:59
为配合xilinx的活动，现贡献全志A20原理图一份 machinnneee\|浏览：3904\|回复：1\| melau 2019-04-12 15:50:08
vivado2014.4编译出现问题站的高尿的远\|浏览：3944\|回复：1\| melau 2019-04-12 15:49:56
关于ISE中DDS的配置问题求教 LAZY17362012\|浏览：3618\|回复：2\| melau 2019-04-12 15:49:17
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（电子书）Verilog HDL数字设计与综合（第二版）夏宇闻等译 dreamjsc\|浏览：12191\|回复：13\| lnbpzzx 2019-03-06 09:42:00
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SPARTAN -3 系列XC3S400的下载和配置问题【硬件优化】 trunftec\|浏览：2719\|回复：0\| trunftec 2019-01-12 15:43:47
ZYNQ FCLK0时钟问题 zwj1234\|浏览：7439\|回复：4\| pigyyf 2018-12-20 23:30:44
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Xilinx引领珠穆朗玛峰之旅 big白菜\|浏览：2400\|回复：0\| big白菜 2018-09-20 14:42:06
求综合错误原因 becoll\|浏览：11587\|回复：11\| yuxinxin1391 2018-07-08 16:59:25
TSL235R-LFTSL237S-LF应用技术用参数资料 szdxtkj\|浏览：2072\|回复：0\| szdxtkj 2018-06-19 10:11:41
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zynq的FCLK_clk0无输出，请问是什么原因？【Zynq】 maxwell1015\|浏览：4153\|回复：0\| maxwell1015 2017-12-22 14:09:55
SPARTAN 3AN系列 excel footprint xiaolin4006\|浏览：1543\|回复：0\| xiaolin4006 2017-12-18 21:31:47
国外一大学的SPARTAN-3E开发板的实验例子（含代码很经典） jiangnanyu\|浏览：18924\|回复：46\| cuiapei 2017-12-07 21:06:22
请问用过Spartan6系列的产生的MIG的吗？MIG产生的源代码只能是verilog吗？可以选择VHDL吗？ tanyushuang727\|浏览：2686\|回复：1\| jhy222222 2017-11-22 19:59:54
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V3学院杯开发大赛【ZingBoard开发手记】 zhaocheng2006\|浏览：1913\|回复：2\| eepwnet 2017-10-17 14:07:49
V3学院杯大赛【ZedBoard开发手记】 zhaocheng2006\|浏览：1941\|回复：3\| eepwnet 2017-10-17 14:07:34
求助irda红外 SIR 协议的发送接收 VHDL设计【Zynq】 xiaozhengzheng\|浏览：1827\|回复：0\| xiaozhengzheng 2017-09-03 22:14:33
书上第一个实验我的超级终端显示的不太对 simonmao8385\|浏览：1930\|回复：2\| machinnneee 2017-07-31 16:06:56
V3学院杯：全可编程SoC嵌入式系统设计大赛 eepwnet\|浏览：1642\|回复：3\| machinnneee 2017-06-20 08:34:17
有用zynq处理器的前辈帮帮我吗？【Zynq】粪海狂蛆\|浏览：2457\|回复：0\| 粪海狂蛆 2017-05-16 19:05:33

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