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[置顶] EEPW新年祝福 lantu\|浏览：23681\|回复：26\| flyway 5天前
[置顶] 这个春节你犒赏自己什么了？分享你的故事，有奖征集咔嚓猫爱刺鱼\|浏览：13277\|回复：14\| leihaozhuce 2026-03-04 23:18:27
[置顶] 4月2日｜北京｜AMD Embedded Tech Day启幕！速来抢位！ nakey\|浏览：5340\|回复：1\| jobs 2026-02-28 15:24:51
[置顶] 打赏了！打赏了！打赏了！ lantu\|浏览：206546\|回复：46\| jwdxu2009 2026-02-07 09:00:31
[置顶] EEPW会员技术专刊《电子设计与芯片应用》纸质版免费索阅在这里 lantu\|浏览：229209\|回复：23\| jj1230 2025-12-03 18:31:42
FSM-based Digital Design using Verilog HDL（分享）【FPGA/CPLD】 Jason_Zhang\|浏览：4653\|回复：0\| Jason_Zhang 2009-12-20 15:59:28
modelsim时序仿真apply to region处怎么设置？【FPGA/CPLD】 becoll\|浏览：4667\|回复：2\| Jason_Zhang 2009-12-19 00:44:18
FFT结果的物理意义（作者圈圈）【DSP系统】 jpp\|浏览：8978\|回复：5\| aiwawen1999 2009-12-18 23:04:16
Art of Writing TestBenches（分享）【FPGA/CPLD】 Jason_Zhang\|浏览：2282\|回复：0\| Jason_Zhang 2009-12-18 12:30:05
请教一下用DSP发出三角波形的问题【DSP系统】风语者\|浏览：5680\|回复：11\| bravewen 2009-12-17 15:23:43
关于signalTap采样时钟的疑问【FPGA/CPLD】 becoll\|浏览：5533\|回复：3\| becoll 2009-12-16 10:20:02
有谁知道Syplify Pro的最新版是哪个吗？【FPGA/CPLD】 Jason_Zhang\|浏览：4185\|回复：4\| Jason_Zhang 2009-12-15 19:19:27
q2生成的pll输出时钟为什么有不应该的相位差？【FPGA/CPLD】 becoll\|浏览：2749\|回复：0\| becoll 2009-12-11 22:59:36
Mobile SDRAM 助你完成低功耗便携式产品开发【DSP系统】 lizaofei168\|浏览：4029\|回复：0\| lizaofei168 2009-12-11 17:12:38
直接数字频率合成器设计（转）【FPGA/CPLD】 Jason_Zhang\|浏览：2840\|回复：3\| Jason_Zhang 2009-12-10 15:57:26
怎样在ISE中查看完整的错误信息？【FPGA/CPLD】 becoll\|浏览：3434\|回复：3\| Jason_Zhang 2009-12-10 10:57:04
程序中使用ISE的IP核的情况下由synplify调用ISE的疑问【FPGA/CPLD】 becoll\|浏览：7040\|回复：2\| Jason_Zhang 2009-12-10 10:52:25
关于synplify pro指示的关键路径【FPGA/CPLD】 becoll\|浏览：3544\|回复：2\| becoll 2009-12-09 15:37:52
chipscope中如何保存设置【FPGA/CPLD】 becoll\|浏览：2949\|回复：1\| Jason_Zhang 2009-12-09 10:06:47
请教：2812的BIOS HWI问题【DSP系统】 maoyong53\|浏览：3740\|回复：2\| pheigenbaum 2009-12-02 20:13:51
请问IDE（ATA）硬盘引脚的逻辑电平是多少？【FPGA/CPLD】 becoll\|浏览：5286\|回复：6\| becoll 2009-12-01 16:16:58
多任务系统看门狗如何实现 ? 【DSP系统】 star800\|浏览：6652\|回复：1\| 1165915006 2009-11-28 20:52:39
如果用单片机上电配置FPGA~~ 【FPGA/CPLD】 matin\|浏览：2655\|回复：1\| forrest1 2009-11-28 08:38:05
如何初始化用IP生成的双口RAM？【FPGA/CPLD】 becoll\|浏览：11551\|回复：9\| Jason_Zhang 2009-11-26 23:18:54
具有什么特征的内部信号可以被chipscope观察？【FPGA/CPLD】 becoll\|浏览：3286\|回复：1\| Jason_Zhang 2009-11-25 10:42:46
求助！【DSP系统】 yelele0820\|浏览：1854\|回复：0\| yelele0820 2009-11-20 21:12:04
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被迫升级了Xilinx ISE 【FPGA/CPLD】 Jason_Zhang\|浏览：3955\|回复：2\| Tony 2009-11-19 15:56:01
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编译后Warning: Macrocell buffer inserted after node "FST"是什么意思？【FPGA/CPLD】 cjz306\|浏览：6193\|回复：4\| Jason_Zhang 2009-11-18 12:54:00
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modelsim可以保存仿真多长时间的波形【FPGA/CPLD】 becoll\|浏览：8873\|回复：6\| Jason_Zhang 2009-11-15 12:02:46
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在modelsim中用testbench仿真，怎样才能更新generic的值? 【FPGA/CPLD】 becoll\|浏览：4994\|回复：2\| becoll 2009-11-13 11:15:47
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TI C54xx DSP 十天速成讲义 <一> 【DSP系统】 huihaitun\|浏览：54224\|回复：137\| fq2007 2009-11-08 09:19:54

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