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altera Cyclone v系列的封装库 october3\|浏览：1671\|回复：0\| october3 2016-08-18 18:58:15
再请教一下，MIG的约束文件中IDELAYCTRL Location Constraints 怎么改呢 xie0jing0\|浏览：12939\|回复：8\| z894811350 2016-03-16 16:40:14
用什么Verilog 编程软件好呢 xie0jing0\|浏览：19706\|回复：16\| yxliu 2016-02-18 16:51:48
Cyclone II PLL问题阿苍\|浏览：3662\|回复：4\| taksonwelson 2016-01-14 10:53:13
求FPGA控制直流电机的代码？Verilog编写的，用按键控制其速度，转向，启停心染红尘\|浏览：2656\|回复：3\| taksonwelson 2016-01-14 10:41:50
求助如何理解这句SyncClk 暗夜涌袭\|浏览：2619\|回复：2\| tokeyman 2015-12-17 22:44:30
用synplify综合Xilinx的core后为什么在Technology view中看不到相应的模块？ becoll\|浏览：10129\|回复：4\| lulu08171537 2015-12-17 18:26:03
完整数字频率计verilog代码 Jason_Zhang\|浏览：7379\|回复：8\| 花涛 2015-12-15 08:38:19
CORDIC计算三角函数（附verilog代码） Jason_Zhang\|浏览：16278\|回复：19\| bgnbgn 2015-11-01 07:48:45
ise 调用 modelsim error loading design 测试testbench 火焰昌\|浏览：2915\|回复：0\| 火焰昌 2015-09-29 11:15:52
ISE环境下使用Verilog进行设计出现问题请教 XJTUMile\|浏览：5805\|回复：2\| XJTUMile 2015-08-27 14:54:23
使用Robei利用verilog语言做ALU设计 fpgachuxue\|浏览：5583\|回复：7\| fpgachuxue 2015-05-21 10:16:03
【应用笔记】AN 479:在Cyclone系列器件中实现LVDS接口设计指南(AN 479: Design Guidelines for Implementin bobgeng\|浏览：3149\|回复：1\| zcgeek 2015-03-22 21:04:22
请教一个Verilog HDL 语法问题 lianxiuxiu\|浏览：2172\|回复：1\| jiahua1010 2015-02-16 15:30:32
TMS320VC33之bootloader应用心得 yangyun\|浏览：1967\|回复：1\| 落月风情 2014-12-21 23:35:59
可综合的Verilog RISC CPU设计（分享） Jason_Zhang\|浏览：6357\|回复：2\| s52646 2014-12-21 22:07:14
Run-time和load-time初始化(zz) yangyun\|浏览：1789\|回复：0\| yangyun 2014-12-21 10:30:23
HELLO五(一)：2812中断系统概述小绵羊\|浏览：1960\|回复：0\| 小绵羊 2014-12-18 19:29:08
HELLO六：2812的时钟系统 dianzi88\|浏览：2404\|回复：0\| dianzi88 2014-12-08 20:01:30
HELLO八(一) 2812EV模块---通用定时器 dianzi88\|浏览：1762\|回复：0\| dianzi88 2014-12-08 19:57:06
HELLO八(二) 2812EV模块---PWM dianzi88\|浏览：2083\|回复：0\| dianzi88 2014-12-08 19:54:48
HELLO九：2812--SCI模块 dianzi88\|浏览：1807\|回复：0\| dianzi88 2014-12-08 19:46:48
CycloneII固件及nios2内核出现逻辑混乱问题阿苍\|浏览：2678\|回复：3\| jackwang 2014-11-28 16:21:29
关于quartues中的Verilog HDL文件如何实现例化！！！小菜110\|浏览：3356\|回复：3\| 南盗 2014-11-18 14:35:16
VHDL,Verilog,System verilog比较苏丹红\|浏览：6102\|回复：15\| moyi 2014-11-14 10:46:04
verilog存储器类型变量，占用资源较多 reg [22:0] rom_base_10Hz [0:laser_out_time_table-1]; miaoxikui\|浏览：2403\|回复：0\| miaoxikui 2014-11-05 23:40:17
FPGA红外接口南盗\|浏览：2113\|回复：0\| 南盗 2014-10-19 18:05:21
#芝麻开门#fpga中reg [29:0] rom_10Hz_jingpin [0:99];类型的存贮器用for循环初始化的问题 miaoxikui\|浏览：2427\|回复：1\| lianggui5 2014-09-25 09:49:21
分享：英文文献-夏宇闻的Verilog教程所翻译的原版教程 letfly\|浏览：5575\|回复：6\| christsong 2014-09-13 20:49:26
HELLO一:如何开始DSP的学习 yangyun\|浏览：1380\|回复：0\| yangyun 2014-08-20 19:54:47
HELLO二:完整工程的构成 yangyun\|浏览：1622\|回复：0\| yangyun 2014-08-20 19:52:45
HELLO九：2812--SCI模块 yangyun\|浏览：1600\|回复：0\| yangyun 2014-08-20 13:50:59
TI之PICCOLO总结一 yangyun\|浏览：1270\|回复：0\| yangyun 2014-08-20 13:02:07
28335编译时解决WARNING_invalid_compiler_option_--float_support=fpu32 九哥\|浏览：4189\|回复：2\| HUSTLRH 2014-08-04 20:41:02
在EDS平台下run as出现“Downloading ELF Process failed” 错误 loveandso\|浏览：8381\|回复：7\| loveandso 2014-07-31 14:30:26
深刻理解数字锁相环叮叮当当\|浏览：5659\|回复：3\| 夜空守望者 2014-07-31 12:17:06
问题：自定义外设avalon接口与外设驱动模块的信号同步问题阿苍\|浏览：2571\|回复：0\| 阿苍 2014-07-29 14:03:26
Verilog实现的以太网接口（分享） Jason_Zhang\|浏览：7535\|回复：16\| QXM123 2014-07-23 21:15:58
怎么样用verilog产生两个相位差为90度的脉冲信号？ fengyelu\|浏览：12024\|回复：6\| htbadboy 2014-07-07 17:15:17
xi新人求助，关于无法load程序的问题 QIQI214\|浏览：57\|回复：10\| paradoxfx 2014-06-30 20:08:36

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