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FPGA测频原理和Verilog代码 【FPGA/CPLD】
L周O逗V逗E|浏览：1825|回复：0| L周O逗V逗E 2017-06-29 14:40:41
ARP协议在FPGA上的实验详解 【FPGA/CPLD】
cqa29|浏览：1658|回复：0| cqa29 2017-06-29 14:36:53
FIR滤波器IP 【FPGA/CPLD】
御剑小子|浏览：1298|回复：0| 御剑小子 2017-06-29 14:29:35
Verilog中define、parameter、localparam的区别 【FPGA/CPLD】
御剑小子|浏览：1901|回复：0| 御剑小子 2017-06-29 14:26:21
芯片设计：Verilog断言（SVA）语法 【FPGA/CPLD】
南城旧梦lgl|浏览：1416|回复：0| 南城旧梦lgl 2017-06-29 14:24:41
Verilog中条件编译命令 `ifdef、`else、`endif 用法 【FPGA/CPLD】
南城旧梦lgl|浏览：1533|回复：0| 南城旧梦lgl 2017-06-29 14:23:13
verilog中的点滴 【FPGA/CPLD】
damifans|浏览：1222|回复：0| damifans 2017-06-29 14:20:39
Verilog实现按键消抖检测教程 【FPGA/CPLD】
dasdzxc|浏览：1392|回复：0| dasdzxc 2017-06-29 14:12:03
Verilog教程—— specify功能 【FPGA/CPLD】
WZH702461|浏览：2531|回复：0| WZH702461 2017-06-29 13:58:45
ZYNQ学习笔记（一） HelloWorld实现 【FPGA/CPLD】
hedibn012|浏览：1346|回复：0| hedibn012 2017-06-29 13:31:55
Verilog基础知识0 【FPGA/CPLD】
wllaodage|浏览：1189|回复：0| wllaodage 2017-06-28 16:28:30
何为锁存器的time borrowing？ 【FPGA/CPLD】
南城旧梦lgl|浏览：1472|回复：0| 南城旧梦lgl 2017-06-28 16:01:38
xilinx CLB资源详解--slice、分布式RAM和Block ram 【FPGA/CPLD】
hedibn012|浏览：1648|回复：0| hedibn012 2017-06-28 15:48:35
微正MZFinger指纹识别算法 【FPGA/CPLD】
xueshawu1|浏览：1334|回复：0| xueshawu1 2017-06-28 15:46:02
关于如何实现在Xilink ZYNQ上将FPGA的IO等资源配置到ARM上 【FPGA/CPLD】
mhx3211|浏览：1650|回复：0| mhx3211 2017-06-28 15:06:06
zynq_devicetree 【FPGA/CPLD】
hedibn012|浏览：1210|回复：0| hedibn012 2017-06-28 14:57:51
时钟频率对程序效率影响测试(Platform: ARM ZYNQ 7000 ZP20 Board) 【FPGA/CPLD】
hedibn012|浏览：1230|回复：0| hedibn012 2017-06-28 14:54:39
zynq_devicetree 【FPGA/CPLD】
hongweidt102|浏览：1139|回复：0| hongweidt102 2017-06-28 14:53:09
PL和PS通过BRAM交互共享数据 【FPGA/CPLD】
hongweidt102|浏览：2273|回复：0| hongweidt102 2017-06-28 14:18:16
使用PS控制DDR3的读写 【FPGA/CPLD】
hongweidt102|浏览：1588|回复：0| hongweidt102 2017-06-28 14:16:35
Xilinx和IBM采用最新PCI Express标准 【FPGA/CPLD】
hedibn012|浏览：1132|回复：0| hedibn012 2017-06-28 13:45:55
CRC循环冗余校验的原理与算法及FPGA实现 【FPGA/CPLD】
浮沉1988|浏览：1749|回复：1| vaioshop 2017-06-28 08:50:34
ISE+Planahead Virtex5 FPGA部分可重构流程示例 【FPGA/CPLD】
littleshrlmp|浏览：1811|回复：1| vaioshop 2017-06-27 21:38:02
Verilog的testbench入门 【FPGA/CPLD】
littleshrlmp|浏览：1673|回复：0| littleshrlmp 2017-06-27 16:56:47
用VHDL/VerilogHD语言开发PLD/FPGA的完整流程VHDL实例 【FPGA/CPLD】
wllaodage|浏览：1467|回复：0| wllaodage 2017-06-27 15:10:25
Choosing FPGA or DSP for your Application 【FPGA/CPLD】
cqa29|浏览：1212|回复：0| cqa29 2017-06-27 14:58:33
FPGAs: the high-end alternative for DSP application 【FPGA/CPLD】
cqa29|浏览：1059|回复：0| cqa29 2017-06-27 14:57:07
MicroBlaze在电机和运动控制方面的设想 【FPGA/CPLD】
南城旧梦lgl|浏览：1272|回复：0| 南城旧梦lgl 2017-06-27 14:45:26
FPGA速度等级问题（Speed Grade） 【FPGA/CPLD】
dasdzxc|浏览：1668|回复：0| dasdzxc 2017-06-27 14:21:43
怎么操作xc7k325通过RS422在线升级FLASH？ 【FPGA/CPLD】
龙山电工|浏览：1228|回复：0| 龙山电工 2017-06-27 13:56:15
win10下运行Quartus13.1问题 【FPGA/CPLD】
littleshrlmp|浏览：1862|回复：0| littleshrlmp 2017-06-26 16:59:05
FPGA 中已经烧进去了基于RISC-V 处理器(开源CPU)，怎么才能把编译好嗯.elf文件加载到FPGA 中执行 【FPGA/CPLD】
zxcxzcvaczv|浏览：1321|回复：0| zxcxzcvaczv 2017-06-26 16:53:10
小白问verilog程序应该怎么写好呢？ 【FPGA/CPLD】
dasdzxc|浏览：1312|回复：1| 孑然儿 2017-06-26 16:46:57
quartus2和modelsim—altera仿真rom ip 【FPGA/CPLD】
xueshawu1|浏览：1947|回复：0| xueshawu1 2017-06-26 16:40:45
quartus II 13.1 nco核仿真报错，error loading design，显示do文件执行到41行是停止 【FPGA/CPLD】
mhx3211|浏览：3269|回复：0| mhx3211 2017-06-26 16:27:01
CCS中Graph不得不知道的8点 【DSP系统】
wangying|浏览：4596|回复：13| ssss1989 2017-05-26 22:14:23
Verilog典型电路设计 【FPGA/CPLD】
zhrscut|浏览：31191|回复：163| workingdu 2017-05-16 15:30:56
Altera FPGA入门电子书 【FPGA/CPLD】
paradoxfx|浏览：11605|回复：56| workingdu 2017-05-09 17:21:00
串行结构的FIR滤波器设计 （含有代码 文档资料）转 【FPGA/CPLD】
billow兔|浏览：2159|回复：2| 18846161416 2017-05-03 11:14:15
FPGA开发讲座2:掌握Verilog的设计利器（ppt） 【FPGA/CPLD】
卢西奥|浏览：11186|回复：51| FPGAwuhan 2017-04-22 14:44:57
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