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共1678条 15/42 |‹ ‹ 13 14 15 16 17 18 › ›| 跳转至页
ROM中存入32个8位数据，我写了读程序我怎么看到我读的数据了 【FPGA/CPLD】
duxvfeng|浏览：3067|回复：2| duxvfeng 2015-04-01 16:47:48
请教一个SDRAM问题 【FPGA/CPLD】
站的高尿的远|浏览：1470|回复：0| 站的高尿的远 2015-04-01 10:43:06
请问下，我做了个简单的带UART的系统，然后进行DEBUG，串口没有输出，可能是什么原因啊 【FPGA/CPLD】
站的高尿的远|浏览：1961|回复：0| 站的高尿的远 2015-03-25 16:15:21
【应用笔记】AN 479:在Cyclone系列器件中实现LVDS接口设计指南(AN 479: Design Guidelines for Implementin 【FPGA/CPLD】
bobgeng|浏览：3016|回复：1| zcgeek 2015-03-22 21:04:22
RE:AFE5805芯片配置 【FPGA/CPLD】
zcgeek|浏览：1553|回复：0| zcgeek 2015-03-19 09:40:58
Xilinx_ISE_Design_Suite_v10_1___CRSiSO 【FPGA/CPLD】
九哥|浏览：2337|回复：2| 风魔小象 2015-03-09 19:59:59
Altera的FPGA内置的乘法器为何是18位的？ 【FPGA/CPLD】
寒月迷亭|浏览：2147|回复：2| 寒月迷亭 2015-03-02 14:38:19
请教一个Verilog HDL 语法问题 【FPGA/CPLD】
lianxiuxiu|浏览：1880|回复：1| jiahua1010 2015-02-16 15:30:32
我的问题：怎么选择 Export 列的属性为*_external connection？ 【FPGA/CPLD】
站的高尿的远|浏览：1636|回复：1| 风魔小象 2015-01-23 22:26:07
FSL总线IP核及其在MicroBlaze系统中的应用 【FPGA/CPLD】
风魔小象|浏览：2097|回复：0| 风魔小象 2015-01-18 21:08:15
将DSP的C++程序写的和ARM/MCU一样简单明了 【DSP系统】
zhuzai|浏览：1964|回复：0| zhuzai 2015-01-09 14:47:42
TMS320VC33之bootloader应用心得 【DSP系统】
yangyun|浏览：1713|回复：1| 落月风情 2014-12-21 23:35:59
可综合的Verilog RISC CPU设计（分享） 【FPGA/CPLD】
Jason_Zhang|浏览：6074|回复：2| s52646 2014-12-21 22:07:14
循环冗余校验 CRC的算法分析和程序实现 【DSP系统】
yangyun|浏览：1436|回复：0| yangyun 2014-12-21 10:34:24
Run-time和load-time初始化(zz) 【DSP系统】
yangyun|浏览：1594|回复：0| yangyun 2014-12-21 10:30:23
C28x Filter Library 使用心得！ 【DSP系统】
yangyun|浏览：1476|回复：0| yangyun 2014-12-21 10:25:19
DSP中归档器（Archiver）的使用 【DSP系统】
yangyun|浏览：1240|回复：0| yangyun 2014-12-21 10:21:54
FIR 滤波器FAQ 【DSP系统】
zhuzai|浏览：1361|回复：0| zhuzai 2014-12-19 20:53:35
如何构建达芬奇的DSP Server(zz) 【DSP系统】
zhuzai|浏览：1226|回复：0| zhuzai 2014-12-19 20:47:20
ARM菜鸟成长记--之二 【DSP系统】
小绵羊|浏览：1071|回复：0| 小绵羊 2014-12-18 19:44:25
FIR和IIR比较 【DSP系统】
小绵羊|浏览：1291|回复：0| 小绵羊 2014-12-18 19:43:34
IIR滤波参数分析 【DSP系统】
小绵羊|浏览：1374|回复：0| 小绵羊 2014-12-18 19:43:14
用于UDMA的CRC16算法代码 【DSP系统】
小绵羊|浏览：1336|回复：0| 小绵羊 2014-12-18 19:39:08
ARBOR宽温级嵌入式主板在医疗多参数监护仪中的应用 【DSP系统】
小绵羊|浏览：1274|回复：0| 小绵羊 2014-12-18 19:36:49
DSP48A1 【FPGA/CPLD】
青城山下|浏览：2015|回复：0| 青城山下 2014-12-14 22:27:42
基于RF5框架的视频处理系统研究 【DSP系统】
小绵羊|浏览：1077|回复：0| 小绵羊 2014-12-04 20:32:28
FlexRay总线控制器和TC1796的MLI接口设计 【DSP系统】
小绵羊|浏览：1835|回复：0| 小绵羊 2014-12-04 20:29:08
基于MSP430单片机的低功耗有源RFID标签设计 【DSP系统】
yangyun|浏览：1428|回复：0| yangyun 2014-12-03 20:24:51
Matlab中 nargin 函数的用法 【DSP系统】
yangyun|浏览：1667|回复：0| yangyun 2014-12-03 20:15:35
使用SecureCRT连接BB-Black上网 【DSP系统】
yangyun|浏览：1285|回复：0| yangyun 2014-12-03 20:08:18
关于DAC芯片中Auxiliary DAC out端口 【FPGA/CPLD】
weilyw|浏览：2048|回复：1| weilyw 2014-12-02 15:02:53
QuartusII 9.0中指定管脚是点击Assignmengts-pins 后出来的界面如下图 【FPGA/CPLD】
奇幻王子|浏览：2245|回复：3| 南盗 2014-11-29 23:30:21
altera的FPGA中DATA[2..7] 这几个管脚可以用作普通IO口吗？ 【FPGA/CPLD】
站的高尿的远|浏览：2618|回复：4| 南盗 2014-11-21 09:08:10
由于需要调用eXpressDSP-compliant运算功能，需要多少额外的运行时间开销 【DSP系统】
小绵羊|浏览：1372|回复：1| zhuzai 2014-11-18 20:19:25
在Quartus12.0里调用modelsim出现下面的错误 【FPGA/CPLD】
站的高尿的远|浏览：1907|回复：4| 南盗 2014-11-18 16:07:55
关于quartues中的Verilog HDL文件如何实现例化！！！ 【FPGA/CPLD】
小菜110|浏览：2987|回复：3| 南盗 2014-11-18 14:35:16
调用shift register用来延时问题 【FPGA/CPLD】
站的高尿的远|浏览：1892|回复：1| 南盗 2014-11-17 20:30:48
VHDL,Verilog,System verilog比较 【FPGA/CPLD】
苏丹红|浏览：5348|回复：15| moyi 2014-11-14 10:46:04
verilog存储器类型变量，占用资源较多 reg [22:0] rom_base_10Hz [0:laser_out_time_table-1]; 【FPGA/CPLD】
miaoxikui|浏览：2119|回复：0| miaoxikui 2014-11-05 23:40:17
强大的工具FPGA Editor（二）修改输入信号极性 【FPGA/CPLD】
九哥|浏览：2896|回复：6| 特洛几 2014-11-03 16:48:35
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