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altera多片FPGA可以用菊花链试JTAG配置吗？ 【FPGA/CPLD】
E益达E|浏览：2359|回复：0| E益达E 2014-07-26 09:14:21
Verilog实现的以太网接口（分享） 【FPGA/CPLD】
Jason_Zhang|浏览：6827|回复：16| QXM123 2014-07-23 21:15:58
ccs 3.3 如何使用realtime mode 使变量能够实时更新 【DSP系统】
zhongshengufo|浏览：4608|回复：1| paradoxfx 2014-07-20 12:57:53
大神救命！关于SmartFusion2 加密后无法解密的问题 【FPGA/CPLD】
zyo0|浏览：1993|回复：2| zyo0 2014-07-15 15:08:01
modelsim仿真ram问题 【FPGA/CPLD】
htbadboy|浏览：2401|回复：2| htbadboy 2014-07-10 15:50:02
怎么样用verilog产生两个相位差为90度的脉冲信号？ 【FPGA/CPLD】
fengyelu|浏览：11531|回复：6| htbadboy 2014-07-07 17:15:17
求教quartus12.1的约束功能在哪找？找了半天没发现，是取消了么？ 【FPGA/CPLD】
simonmao8385|浏览：1633|回复：0| simonmao8385 2014-07-01 15:33:13
请教一下，用altium designer 10怎样正确使用research功能？ 【FPGA/CPLD】
站的高尿的远|浏览：1535|回复：0| 站的高尿的远 2014-06-26 09:24:57
altium designer 10生成PCI图形，想去除标注 【FPGA/CPLD】
iter2012|浏览：1803|回复：0| iter2012 2014-06-26 09:24:32
C6000多核常见问题汇总2：Linux Part 【DSP系统】
内马尔|浏览：2199|回复：1| freelyboy 2014-06-08 12:00:55
C6000多核常见问题汇总1：ARM Part 【DSP系统】
内马尔|浏览：2360|回复：3| freelyboy 2014-06-08 12:00:08
C6000多核常见问题汇总4：Misc Part 【DSP系统】
内马尔|浏览：2620|回复：2| freelyboy 2014-06-08 11:59:31
求教SDRAM的问题 【FPGA/CPLD】
站的高尿的远|浏览：1555|回复：0| 站的高尿的远 2014-05-30 13:47:51
用quartusII实现连续可调混频器，求高手指点！！！ 【FPGA/CPLD】
zmh7L|浏览：2733|回复：2| richyhuang 2014-05-26 16:30:18
求助：用ISE自带的Isim仿真时提示fatal error 【FPGA/CPLD】
zl19891025|浏览：5331|回复：1| li308922492 2014-05-22 14:11:36
求教为什么modelsim里有altera的库 【FPGA/CPLD】
htbadboy|浏览：1911|回复：3| htbadboy 2014-05-20 09:31:52
求助 modelsim10.1仿真quartus初始化的rom（mif）数据 没有数据输出 【FPGA/CPLD】
让奇迹飞|浏览：2567|回复：1| 让四轴飞 2014-05-19 16:04:32
怎么没看到视频终中的DDR代码 【FPGA/CPLD】
夜空守望者|浏览：1674|回复：1| jackwang 2014-05-10 20:50:39
强大的工具FPGA Editor（四）修改LUT的功能 【FPGA/CPLD】
九哥|浏览：2886|回复：6| zyo0 2014-05-05 11:15:25
【资料分享】FPGA-veriglogHDL语法学习 【FPGA/CPLD】
dajianli|浏览：2089|回复：1| cyh924417122 2014-05-02 18:00:22
初学者对quartus ii里几种电路视图的疑问 【FPGA/CPLD】
zyo0|浏览：2262|回复：1| Nancy 2014-04-25 13:55:46
基于DSP+Builder和DDS的正交信号发生器的设计 【DSP系统】
祝家庄|浏览：2413|回复：2| fengye99 2014-04-21 10:07:27
Quartus 【FPGA/CPLD】
疯丫头冷暖自知|浏览：1620|回复：0| 疯丫头冷暖自知 2014-04-19 11:17:19
OMAPL138 【DSP系统】
panloong|浏览：2250|回复：1| paradoxfx 2014-04-15 15:26:06
verilog中的reg型变量，wire型变量初值是多少？？ 【FPGA/CPLD】
52mcu|浏览：19832|回复：5| czzsj 2014-04-09 14:55:52
矩阵按键锁定问题 【FPGA/CPLD】
zcgeek|浏览：2290|回复：3| lianggui5 2014-04-07 12:56:40
急求tms470的HET口的中文资料英文是（TMS470R1x High-End Timer (HET) Reference Guide文件编号SPUN199） 【DSP系统】
英雄|浏览：5085|回复：7| paradoxfx 2014-04-02 19:08:13
电子书Understanding DSP 【DSP系统】
paradoxfx|浏览：1520|回复：2| paradoxfx 2014-03-31 20:12:24
调用DSP Builder库的问题 【FPGA/CPLD】
栾森达|浏览：2233|回复：3| 栾森达 2014-03-22 11:41:12
自定IP核的，协议选为AXI的这种IP核时，user logic里面用得怎么样啊 【FPGA/CPLD】
roger|浏览：1531|回复：0| roger 2014-03-13 13:26:53
新手求助.关于verilog 【FPGA/CPLD】
随峰|浏览：1625|回复：0| 随峰 2014-03-08 15:09:22
跪求ZRTECH外设板PERI1-8KD的资料 【FPGA/CPLD】
a972043362|浏览：2279|回复：6| a972043362 2014-03-06 13:20:08
数字信号处理实践方法 EC.Ifeachor著，罗鹏飞等译 【DSP系统】
Hugo801122|浏览：1903|回复：1| paradoxfx 2014-03-06 12:34:07
【Nios II 处理器】Nios II性能基准测试(Nios II Performance Benchmarks) 【FPGA/CPLD】
bobgeng|浏览：2681|回复：1| hxing 2014-02-15 20:05:54
Xilinx ISE14.7 VHDL文件综合报错（conv_integer），大家帮忙看看。 【FPGA/CPLD】
阿苍|浏览：5985|回复：2| Snake0301 2014-02-14 16:06:56
调用Altera的IP库，未经授权时可使用多久啊？ 【FPGA/CPLD】
myxxyy|浏览：6274|回复：7| 华帆科技 2014-02-08 11:39:15
求指点Rapidio ipcore FPGA 【FPGA/CPLD】
fenglema|浏览：3821|回复：2| 华帆科技 2014-02-08 11:32:07
Quartus II 代码综合后，为什么寄存器CLRN端的RTL和Technology Map Viewer不一样？ 【FPGA/CPLD】
chinatsw|浏览：7509|回复：7| Snake0301 2014-02-07 01:38:33
使用C2prog烧写C2000出错 【DSP系统】
57TiDsp|浏览：6017|回复：7| paradoxfx 2014-01-22 23:31:15
IEEE出版的verilog教程 【FPGA/CPLD】
Jason_Zhang|浏览：3094|回复：2| 起个名字十分男 2014-01-20 22:06:27
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