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VHDL学习笔记 【FPGA/CPLD】
叮叮当当|浏览：14309|回复：5| 2007-04-26 22:50:00
邀请参与－Verilog 编程规范 编写 【FPGA/CPLD】
叮叮当当|浏览：2649|回复：1| 2007-04-26 22:46:00
定点小数的VHDL实现 【FPGA/CPLD】
叮叮当当|浏览：4047|回复：0| 2007-04-26 22:38:00
第三章 Verilog语言要素 【FPGA/CPLD】
yzlhccdec|浏览：3229|回复：9| 2007-04-26 07:00:00
[转帖]新手学习资料 第1章 硬件描述语言VHDL 【FPGA/CPLD】
yzlhccdec|浏览：3416|回复：4| 2007-04-26 03:06:00
Verilog的打印系统函数 【FPGA/CPLD】
叮叮当当|浏览：7867|回复：0| 2007-04-25 22:44:00
电子钟vhdl代码实现 【FPGA/CPLD】
叮叮当当|浏览：3087|回复：0| 2007-04-25 01:27:00
Verilog-HDL Code Style（初学者） 【FPGA/CPLD】
叮叮当当|浏览：2872|回复：0| 2007-04-25 01:26:00
循环的verilog实现方式 【FPGA/CPLD】
叮叮当当|浏览：4429|回复：1| 2007-04-25 01:23:00
乘法器的verilog代码实现（初学者） 【FPGA/CPLD】
叮叮当当|浏览：7028|回复：0| 2007-04-25 00:30:00
谈谈verilog奇数分频的程序实现（verilog） 【FPGA/CPLD】
叮叮当当|浏览：3260|回复：0| 2007-04-25 00:20:00
简单实用的FPGA备频程序（verilog） 【FPGA/CPLD】
叮叮当当|浏览：2738|回复：0| 2007-04-25 00:15:00
请教quartus6.0的一个VHDL程序问题 【FPGA/CPLD】
gyc1204|浏览：6075|回复：1| 2007-04-23 07:40:00
SOS 求助 用Verilog实现QPSK的调制解调 【FPGA/CPLD】
huobing8506|浏览：3827|回复：1| 2007-04-04 00:22:00
VHDL设计多功能数字钟 【FPGA/CPLD】
biao520|浏览：5091|回复：2| 2007-03-29 20:50:00
Verilog讨论组精彩内容摘录(一) 【FPGA/CPLD】
noisyroad|浏览：2869|回复：1| 2007-03-29 20:46:00
Verilog讨论组精彩内容摘录(二) 【FPGA/CPLD】
noisyroad|浏览：2613|回复：1| 2007-03-29 20:45:00
Verilog讨论组精彩内容摘录(三) 【FPGA/CPLD】
noisyroad|浏览：2772|回复：1| 2007-03-29 20:45:00
Verilog HDL常见问题 【FPGA/CPLD】
noisyroad|浏览：3380|回复：1| 2007-03-29 20:44:00
中文版Verilog HDL简明教程：第1章 简介 【FPGA/CPLD】
noisyroad|浏览：2905|回复：1| 2007-03-29 20:43:00
中文版Verilog HDL简明教程：第2章 HDL指南 【FPGA/CPLD】
noisyroad|浏览：2645|回复：1| 2007-03-29 20:43:00
中文版Verilog HDL简明教程：第3章 Verilog语言要素 【FPGA/CPLD】
noisyroad|浏览：3621|回复：1| 2007-03-29 20:43:00
中文版Verilog HDL简明教程：第4章 表 达 式 【FPGA/CPLD】
noisyroad|浏览：2730|回复：1| 2007-03-29 20:42:00
中文版Verilog HDL简明教程：第5章 门电平模型化 【FPGA/CPLD】
noisyroad|浏览：3244|回复：1| 2007-03-29 20:42:00
基于VHDL语言的智能拨号报警器的设计 【FPGA/CPLD】
noisyroad|浏览：3235|回复：1| 2007-03-29 20:42:00
一种基于移位寄存器的CAM的Verilog HDL实现 【FPGA/CPLD】
noisyroad|浏览：2915|回复：1| 2007-03-29 20:42:00
Verilog HDL 程序举例--测试向量（Test Bench）和波形发生器： 【FPGA/CPLD】
noisyroad|浏览：5315|回复：1| 2007-03-29 20:41:00
Verilog HDL 程序举例--数据接口: 【FPGA/CPLD】
noisyroad|浏览：2935|回复：1| 2007-03-29 20:41:00
Verilog HDL 程序举例--状态机举例： 【FPGA/CPLD】
noisyroad|浏览：3283|回复：1| 2007-03-29 20:40:00
Verilog HDL 程序举例--基本时序逻辑功能： 【FPGA/CPLD】
noisyroad|浏览：3380|回复：1| 2007-03-29 20:40:00
VerilogHDL简介 【FPGA/CPLD】
noisyroad|浏览：3162|回复：1| 2007-03-29 20:40:00
LVDS技术原理和设计简介 【FPGA/CPLD】
noisyroad|浏览：2931|回复：1| 2007-03-29 20:39:00
SystemVerilog语言简介(一) 【FPGA/CPLD】
noisyroad|浏览：4035|回复：1| 2007-03-29 20:39:00
SystemVerilog语言简介(二) 【FPGA/CPLD】
noisyroad|浏览：4313|回复：1| 2007-03-29 20:39:00
用VHDL设计有限状态机的方法 【FPGA/CPLD】
noisyroad|浏览：3196|回复：1| 2007-03-29 20:38:00
Verilog HDL 程序举例--基本语法： 【FPGA/CPLD】
noisyroad|浏览：2769|回复：1| 2007-03-29 20:37:00
Verilog HDL 程序举例--基本组合逻辑功能： 【FPGA/CPLD】
noisyroad|浏览：2794|回复：1| 2007-03-29 20:37:00
SystemVerilog语言简介(三) 【FPGA/CPLD】
noisyroad|浏览：3659|回复：1| 2007-03-29 20:36:00
SystemVerilog语言简介(四) 【FPGA/CPLD】
noisyroad|浏览：5730|回复：1| 2007-03-29 20:35:00
用Verilog HDL实现I2C总线功能 【FPGA/CPLD】
noisyroad|浏览：2686|回复：1| 2007-03-29 20:20:00
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