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Quartus II 代码综合后，为什么寄存器CLRN端的RTL和Technology Map Viewer不一样？

chinatsw
菜鸟
2014-02-04 15:25:54     打赏
module test
(
	input CLK,RSTn,
	input a,
	output b
);
	
	reg rb;
	always@(posedge CLK or negedge RSTn)
		if(!RSTn)
			rb<=0;
		else
			rb<=a;
	
	assign b=rb;
			
endmodule

RTL Viewer：

RTL



Technology Map ：

Technology Map ：

看寄存器的CLRN端，为什么RTL视图中的还多了个取反

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关键词： Quartus     综合     寄存器     Technology    

chinatsw
菜鸟
2014-02-06 17:31:17     打赏
2楼
哈哈，寒假在家也闲，找点东西学学。我是初学的，还请教大神在哪里才能查看FPGA器件的D-FF复位端是否是高电平有效？我的FPGA是EP4CE6F17C8，

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