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Quartus II 代码综合后,为什么寄存器CLRN端的RTL和Technology Map Viewer不一样?

菜鸟
2014-02-04 15:25:54     打赏
module test
(
	input CLK,RSTn,
	input a,
	output b
);
	
	reg rb;
	always@(posedge CLK or negedge RSTn)
		if(!RSTn)
			rb<=0;
		else
			rb<=a;
	
	assign b=rb;
			
endmodule

RTL Viewer:

RTL



Technology Map :

Technology Map :

看寄存器的CLRN端,为什么RTL视图中的还多了个取反




关键词: Quartus     综合     寄存器     Technology    

院士
2014-02-05 10:42:26     打赏
2楼
LZ,春节期间也在公关,赞一个!

院士
2014-02-05 10:43:59     打赏
3楼
友情帮顶一下吧~~

院士
2014-02-05 10:53:13     打赏
4楼
来了,不会已经北京了吧

院士
2014-02-05 11:18:43     打赏
5楼
预计今天晚上到北京。

高工
2014-02-05 16:11:09     打赏
6楼

RTLviewer显示的是编译后的结果

显示的图形都是调用标准单元的结果

跟工艺库,FPGA类型,都没有关系;

而Technology Map Viewer 显示的是已经编译并映射到对应的FPGA器件中,

是fitter后的结果。


撸主可以看看你选择的FPGA器件是不是包含有标准单元

或者说撸主选择的FPGA器件的D-FF复位端是高电平有效呢


菜鸟
2014-02-06 17:31:17     打赏
7楼
哈哈,寒假在家也闲,找点东西学学。我是初学的,还请教大神在哪里才能查看FPGA器件的D-FF复位端是否是高电平有效?我的FPGA是EP4CE6F17C8,

高工
2014-02-07 01:38:33     打赏
8楼

啊,其实并不是器件内部包含有DFF

而是通过对器件內建的各种逻辑单元进行布线连接构成的

每个不同簇器件的特性千差万别

撸主可以参考一下厂家的datasheet和user guid,了解一下可编程逻辑器件工作的机理


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