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FPGA  -  PLL

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IPCORE之PLL-ISE操作工具 【FPGA/CPLD】
FPGA江湖|浏览：328|回复：2| yinwuqing 2023-04-07 09:37:35
基于FPGA的提取位同步时钟DPLL设计
卢风|浏览：426|回复：0| 卢风 2021-06-14 23:57:48
强大的工具FPGA Editor（三）修改PLL的属性 【FPGA/CPLD】
九哥|浏览：4514|回复：13| zxopenljx 2020-10-10 15:37:19
Altera可重配置PLL使用手册（分享） 【FPGA/CPLD】
Jason_Zhang|浏览：37725|回复：130| miqi 2020-05-20 16:54:17
ALTPLL的使用 【FPGA/CPLD】
南盗|浏览：4722|回复：10| 同煮山川 2020-05-09 14:07:32
使用Cyclone器件中的PLL 【FPGA/CPLD】
zxopenljx|浏览：959|回复：0| zxopenljx 2020-04-10 11:41:39
Cyclone II PLL问题 【FPGA/CPLD】
阿苍|浏览：3031|回复：4| taksonwelson 2016-01-14 10:53:13
PLL模块使用中的一些错误（转） 【FPGA/CPLD】
风魔小象|浏览：2259|回复：0| 风魔小象 2015-03-12 19:25:17
板子上的fpga 芯片EP3C10E144C8N pll 只输出几百k的方波（应输出100Mhz）这是为什么？？ 【FPGA/CPLD】
52mcu|浏览：2475|回复：3| 52mcu 2014-05-16 10:10:33
【用户指南】Altera锁相环(ALTERA_PLL)宏功能模块用户指南(Altera Phase-Locked Loop (ALTERA_PLL) Megaf 【FPGA/CPLD】
bobgeng|浏览：3243|回复：1| zhq2003 2013-06-27 13:31:03
【求助】54xxDSP 硬件配置PLL问题 【DSP系统】
hanshuyujifen2|浏览：1979|回复：0| hanshuyujifen2 2012-09-12 15:16:52
【应用笔记】使用ALTERA_PLL和ALTERA_PLL_RECONFIG宏功能模块实现小数PLL重配置V1.1(Implementing Fractiona 【FPGA/CPLD】
bobgeng|浏览：2689|回复：0| bobgeng 2012-05-26 15:35:53
【应用笔记】AN432:在Stratix II和HardCopy II中使用不同的PLL设置(AN 432: Using Different PLL Setti 【FPGA/CPLD】
bobgeng|浏览：1814|回复：0| bobgeng 2012-05-26 14:46:26
骏龙科技文章9：Modelsim6.0 PLL仿真步骤 【FPGA/CPLD】
叮叮当当|浏览：3221|回复：1| h254479169 2012-05-25 11:29:55
【应用笔记】在APEX器件中使用ClockLock和ClockBoost PLL功能(Using the ClockLock & ClockBoost PLL 【FPGA/CPLD】
bobgeng|浏览：1901|回复：0| bobgeng 2012-05-24 22:39:33
【应用笔记】在Stratix和Stratix GX器件中实现PLL重配置(Implementing PLL Reconfiguration in Stratix 【FPGA/CPLD】
bobgeng|浏览：1936|回复：0| bobgeng 2012-05-24 21:09:13
【应用笔记】AN367:在Stratix II器件中实现PLL重配置(AN 367: Implementing PLL Reconfiguration in S 【FPGA/CPLD】
bobgeng|浏览：1848|回复：0| bobgeng 2012-05-20 22:21:08
【应用笔记】在Stratix II器件中使用altlvds宏功能模块和外部PLL选项(Design Example Using the altlvds Mega 【FPGA/CPLD】
bobgeng|浏览：2292|回复：0| bobgeng 2012-05-19 22:14:43
【应用笔记】理解Stratix II器件的PLL时序(Understanding PLL Timing for Stratix II Devices) 【FPGA/CPLD】
bobgeng|浏览：1721|回复：0| bobgeng 2012-05-19 22:12:18
【应用笔记】在Stratix III和Stratix IV器件中实现PLL重配置(Implementing PLL Reconfiguration in Str 【FPGA/CPLD】
bobgeng|浏览：1638|回复：0| bobgeng 2012-05-18 16:07:45
【应用笔记】高性能FPGA锁相环的TimeQuest时序分析(High-Performance FPGA PLL Analysis with TimeQuest 【FPGA/CPLD】
bobgeng|浏览：1963|回复：0| bobgeng 2012-05-16 16:00:59
【应用手册】Implementing PLL Reconfiguration in Cyclone III Devices 【FPGA/CPLD】
bobgeng|浏览：1975|回复：0| bobgeng 2012-05-14 10:45:47
【应用手册】AN 578: Manual Placement of CMU PLLs and ATX PLLs in Stratix IV GX and GT 【FPGA/CPLD】
bobgeng|浏览：1607|回复：0| bobgeng 2012-05-12 17:32:10
【应用手册】Dynamic Reconfiguration of Transceiver Channels Using Multiple PLLs in Str 【FPGA/CPLD】
bobgeng|浏览：1860|回复：0| bobgeng 2012-05-12 11:10:36
关于cycloneiii PLL的warning 【FPGA/CPLD】
happysheep|浏览：5095|回复：2| happysheep 2012-04-27 14:11:01
【应用手册】General-Purpose PLLs in Stratix & Stratix GX Devices 【FPGA/CPLD】
bobgeng|浏览：1543|回复：0| bobgeng 2012-04-23 09:46:16
【应用手册】Implementing Fractional PLL Reconfiguration with ALTERA_PLL and ALTERA_PLL 【FPGA/CPLD】
bobgeng|浏览：1907|回复：0| bobgeng 2012-04-23 08:09:19
【白皮书】利用高级Cyclone III FPGA PLL，增加灵活性，提高集成度 【FPGA/CPLD】
bobgeng|浏览：2020|回复：0| bobgeng 2012-04-14 11:05:32
求教FPGA实现PLL的问题 【FPGA/CPLD】
nuaatony|浏览：2619|回复：2| jerryeepw 2011-12-07 20:22:45
altera PLL User Guide（分享） 【FPGA/CPLD】
Jason_Zhang|浏览：6959|回复：20| touhousama 2011-08-01 22:43:01
DCM 与 PLL的级联使用？ 【FPGA/CPLD】
xie0jing0|浏览：8420|回复：6| xie0jing0 2010-04-14 14:00:42
q2生成的pll输出时钟为什么有不应该的相位差？ 【FPGA/CPLD】
becoll|浏览：2275|回复：0| becoll 2009-12-11 22:59:36
骏龙科技文章24：使用Cyclone器件中的PLL 【FPGA/CPLD】
叮叮当当|浏览：2236|回复：0| 叮叮当当 2008-01-23 13:50:31
用PLL好还是组合逻辑好？？？ 【FPGA/CPLD】
叮叮当当|浏览：2505|回复：1| b03212316 2008-01-18 23:30:38
DPLL 【FPGA/CPLD】
lgdf99|浏览：2455|回复：1| 2007-07-26 17:41:46
[求助]求助关于5402 PLL软件配置 【DSP系统】
lwx_123|浏览：2501|回复：1| 2005-06-28 05:52:13
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